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參數(shù)資料
| 型號： | UPD70F3306GC-8BT |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP80 |
| 封裝： | 14 X 14 MM, PLASTIC, TQFP-80 |
| 文件頁數(shù)： | 57/755頁 |
| 文件大?。?/td> | 4717K |
| 代理商： | UPD70F3306GC-8BT |
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Preliminary User’s Manual U16895EJ1V0UD
15
19.3.4
Interrupt control register (xxlCn) ...................................................................................................592
19.3.5
Interrupt mask registers 0, 1, 3 (IMR0, IMR1, IMR3) ....................................................................594
19.3.6
In-service priority register (ISPR)..................................................................................................595
19.3.7
ID flag ...........................................................................................................................................596
19.3.8
Watchdog timer mode register 1 (WDTM1) ..................................................................................597
19.4
External Interrupt Request Input Pins (NMI, INTP0 to INTP7) ............................................. 598
19.4.1
Noise elimination ..........................................................................................................................598
19.4.2
Edge detection..............................................................................................................................600
19.5
Software Exceptions................................................................................................................ 604
19.5.1
Operation......................................................................................................................................604
19.5.2
Restore .........................................................................................................................................605
19.5.3
EP flag ..........................................................................................................................................606
19.6
Exception Trap ......................................................................................................................... 607
19.6.1
Illegal opcode ...............................................................................................................................607
19.6.2
Debug trap....................................................................................................................................609
19.7
Multiple Interrupt Servicing Control ...................................................................................... 611
19.8
Interrupt Response Time......................................................................................................... 613
19.9
Periods in Which Interrupts Are Not Acknowledged by CPU ............................................. 614
19.10 Cautions.................................................................................................................................... 614
CHAPTER 20 KEY INTERRUPT FUNCTION ......................................................................................615
20.1
Function .................................................................................................................................... 615
20.2
Register..................................................................................................................................... 616
CHAPTER 21 STANDBY FUNCTION ...................................................................................................617
21.1
Overview ................................................................................................................................... 617
21.2
Registers................................................................................................................................... 620
21.3
HALT Mode ............................................................................................................................... 623
21.3.1
Setting and operation status .........................................................................................................623
21.3.2
Releasing HALT mode .................................................................................................................623
21.4
IDLE Mode................................................................................................................................. 625
21.4.1
Setting and operation status .........................................................................................................625
21.4.2
Releasing IDLE mode...................................................................................................................626
21.5
STOP Mode ............................................................................................................................... 628
21.5.1
Setting and operation status .........................................................................................................628
21.5.2
Releasing STOP mode .................................................................................................................629
21.5.3
Securing oscillation stabilization time when STOP mode is released...........................................631
21.6
Subclock Operation Mode....................................................................................................... 632
21.6.1
Setting and operation status .........................................................................................................632
21.6.2
Releasing subclock operation mode.............................................................................................632
21.7
Sub-IDLE Mode......................................................................................................................... 634
21.7.1
Setting and operation status .........................................................................................................634
21.7.2
Releasing sub-IDLE mode............................................................................................................634
CHAPTER 22 RESET FUNCTION ........................................................................................................636
22.1
Overview ................................................................................................................................... 636
22.2
Configuration............................................................................................................................ 636
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD70F3345GJ(A)-GAE-AX | 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144 |
| UPD70F3357GJ(A)-GAE-AX | 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144 |
| UPD70F3347GJ | 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144 |
| UPD70F3454F1-DA9-A | 32-BIT, FLASH, 64 MHz, RISC MICROCONTROLLER, PBGA161 |
| UPD71087G | 71087 SERIES, 8-BIT TRANSCEIVER, INVERTED OUTPUT, PDSO20 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD70F3306GK-9EU-A | 制造商:Renesas Electronics 功能描述:V850ES 20MHz 制造商:Renesas Electronics 功能描述:V850ES 20MHz Cut Tape |
| UPD70F3306YGK-9EU-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD70F3308GK-9EU-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD70F3313GC-8EU-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD70F3313YGC-8EA-A | 制造商:Renesas Electronics Corporation 功能描述: |
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