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參數(shù)資料
| 型號： | TMX320DM6443ZWT |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media System-on-Chip |
| 中文描述： | 數(shù)字媒體系統(tǒng)片上 |
| 文件頁數(shù)： | 159/221頁 |
| 文件大小： | 1582K |
| 代理商： | TMX320DM6443ZWT |
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www.ti.com
TMS320DM6443
Digital Media System-on-Chip
SPRS282E–DECEMBER 2005–REVISED MARCH 2007
6.13.1.1
Resizer
The resizer module can accept input image/video data from the DDR2. The output of the resizer module is
sent to DDR2. The following features are supported by the resizer module.
An output width up to 1280 horizontal pixels.
Input from external DDR2.
Up to 4x upsampling (digital zoom).
Bi-cubic interpolation (4-tap horizontal, 4-tap vertical) can be implemented with the programmable filter
coefficients.
8 phases of filter coefficients.
Optional bi-linear interpolation for the chrominance components.
Up to 1/4x downsampling
4-tap horizontal and 4-tap vertical filter coefficients (with 8-phases) for 1x to 1/2x downsampling
1/2x to 1/4x downsampling, for 7-tap mode with 4-phases.
Resizing either YUV 4:2:2 packed data (16-bits) or color separate data (8-bit data within DDR) that is
contiguous.
Separate/independent resizing factor for the horizontal and vertical directions.
Upsampling and downsampling ratios that are available are: 256/N, with N ranging from 64 to 1024.
Programmable luminance sharpening after the horizontal resizing and before the vertical resizing step.
The Resizer register memory mapping is shown in
Table 6-48
.
Table 6-48. Resizer Register Descriptions
HEX ADDRESS RANGE
0x01C7 0C00
0x01C7 0C04
0x01C7 0C08
0x01C7 0C0C
0x01C7 0C10
0x01C7 0C14
0x01C7 0C18
0x01C7 0C1C
0x01C7 0C20
0x01C7 0C24
0x01C7 0C28
0x01C7 0C2C
0x01C7 0C30
0x01C7 0C34
0x01C7 0C38
0x01C7 0C3C
0x01C7 0C40
0x01C7 0C44
0x01C7 0C48
0x01C7 0C4C
0x01C7 0C50
0x01C7 0C54
0x01C7 0C58
0x01C7 0C5C
0x01C7 0C60
REGISTER ACRONYM
DESCRIPTION
PID
PCR
RSZ_CNT
OUT_SIZE
IN_START
IN_SIZE
SDR_INADD
SDR_INOFF
SDR_OUTADD
SDR_OUTOFF
HFILT10
HFILT32
HFILT54
HFILT76
HFILT98
HFILT1110
HFILT1312
HFILT1514
HFILT1716
HFILT1918
HFILT2120
HFILT2322
HFILT2524
HFILT2726
HFILT2928
Peripheral Revision and Class Information
Peripheral Control Register
Resizer Control Bits
Output Width and Height After Resizing
Input Starting Information
Input Width and Height Before Resizing
Input SDRAM Address
SDRAM Offset for the Input Line
Output SDRAM Address
SDRAM Offset for the Output Line
Horizontal Filter Coefficients 1 and 0
Horizontal Filter Coefficients 3 and 2
Horizontal Filter Coefficients 5 and 4
Horizontal Filter Coefficients 7 and 6
Horizontal Filter Coefficients 9 and 8
Horizontal Filter Coefficients 11 and 10
Horizontal Filter Coefficients 13 and 12
Horizontal Filter Coefficients 15 and 14
Horizontal Filter Coefficients 17 and 16
Horizontal Filter Coefficients 19 and 18
Horizontal Filter Coefficients 21 and 20
Horizontal Filter Coefficients 23 and 22
Horizontal Filter Coefficients 25 and 24
Horizontal Filter Coefficients 27 and 26
Horizontal Filter Coefficients 29 and 28
Submit Documentation Feedback
Peripheral and Electrical Specifications
159
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