參數(shù)資料
型號： SYM53C896
廠商： LSI CORP
元件分類： 總線控制器
英文描述： PCI to Dual Channel Ultra2 SCSI Multifunction Controller(PCI與雙通道Ultra2 SCSI連接多功能控制器)
中文描述： SCSI BUS CONTROLLER, PBGA329
封裝： 31 X 31 MM, 1.27 MM PITCH, PLASTIC, BGA-329
文件頁數(shù)： 56/360頁
文件大?。?/td> 3297K
代理商： SYM53C896
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2-30
Functional Description
the 7-bit value of the DFIFO register. AND the result with 0x7F
for a byte count between zero and 112.
If the DMA FIFO size is set to 944 bytes (bit 5 of the
Chip Test
Five (CTEST5)
register is set), subtract the 10 least significant
bits of the
DMA Byte Counter (DBC)
register from the 10-bit
value of the DMA FIFO Byte Offset Counter, which consists of
bits [1:0] in the
Chip Test Five (CTEST5)
register and bits [7:0]
of the
DMA FIFO (DFIFO)
register. AND the result with 0x3FF
for a byte count between zero and 944.
Step 2.
Read bit 5 in the
SCSI Status Zero (SSTAT0)
and
SCSI Status
Two (SSTAT2)
registers to determine if any bytes are left in the
SCSI Output Data Latch (SODL)
register. If bit 5 is set in the
SSTAT0 or SSTAT2 register, then the least significant byte or
the most significant byte in the SODL register is full. Checking
this bit also reveals bytes left in the SODL register from a
Chained Move operation with an odd byte count.
Synchronous SCSI Send –
Step 1.
If the DMA FIFO size is set to 112 bytes (bit 5 of the
Chip Test
Five (CTEST5)
register cleared), look at the
DMA FIFO (DFIFO)
and
DMA Byte Counter (DBC)
registers and calculate if there
are bytes left in the DMA FIFO. To make this calculation,
subtract the seven least significant bits of the DBC register from
the 7-bit value of the DFIFO register. AND the result with 0x7F
for a byte count between zero and 112.
If the DMA FIFO size is set to 944 bytes (bit 5 of the
Chip Test
Five (CTEST5)
register is set), subtract the 10 least significant
bits of the
DMA Byte Counter (DBC)
register from the 10-bit
value of the DMA FIFO Byte Offset Counter, which consists of
bits [1:0] in the
Chip Test Five (CTEST5)
register and bits [7:0]
of the
DMA FIFO (DFIFO)
register. AND the result with 0x3FF
for a byte count between zero and 944.
Step 2.
Read bit 5 in the
SCSI Status Zero (SSTAT0)
and
SCSI Status
Two (SSTAT2)
registers to determine if any bytes are left in the
SODL register. If bit 5 is set in the SSTAT0 or SSTAT2 register,
then the least significant byte or the most significant byte in the
SCSI Output Data Latch (SODL)
register is full. Checking this bit
also reveals bytes left in the SODL register from a Chained
Move operation with an odd byte count.
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PDF描述
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