參數(shù)資料
型號： SYM53C896
廠商： LSI CORP
元件分類： 總線控制器
英文描述： PCI to Dual Channel Ultra2 SCSI Multifunction Controller(PCI與雙通道Ultra2 SCSI連接多功能控制器)
中文描述： SCSI BUS CONTROLLER, PBGA329
封裝： 31 X 31 MM, 1.27 MM PITCH, PLASTIC, BGA-329
文件頁數(shù)： 349/360頁
文件大?。?/td> 3297K
代理商： SYM53C896
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Index
IX-9
quadrupler enable (QEN)
4-93
quadrupler select (QSEL)
4-94
scratch
byte register (SBR)
4-72
register A (SCRATCHA)
4-68
register B (SCRATCHB)
4-104
registers C–R (SCRATCHC–SCRATCHR)
4-105
script fetch selector (SFS)
4-107
SCRIPTS
instruction
2-51
interrupt instruction received (SIR)
4-43
,
4-71
processor
2-18
internal RAM for instruction storage
2-19
performance
2-18
RAM
2-4
,
2-19
running (SRUN)
4-55
SCSI
ATN condition - target mode (M/A)
4-75
bit mode change (SBMC)
4-82
bus control lines (SBCL)
4-42
bus data lines (SBDL)
4-104
bus interface
2-32
,
2-39
bus mode change (SBMC)
4-77
byte count (SBC)
4-111
C_D/ signal (C_D)
4-49
chip ID (SCID)
4-32
clock (SCLK)
3-13
,
4-93
control enable (SCE)
4-94
control one (SCNTL1)
2-26
,
4-25
control three (SCNTL3)
2-39
,
2-40
,
4-30
control two (SCNTL2)
2-51
,
4-28
control zero (SCNTL0)
2-26
,
4-22
cumulative byte count
4-112
data high impedance (ZSD)
4-63
destination ID (SDID)
4-38
disconnect unexpected (SDU)
4-28
encoded destination ID
5-21
FIFO test read (STR)
4-97
FIFO test write (STW)
4-98
first byte received (SFBR)
4-39
function A control
3-15
function A GPIO signals
3-11
function A signals
3-13
function B control
3-18
function B GPIO signals
3-12
function B signals
3-16
functional description
2-18
gross error (SGE)
4-76
,
4-80
hysteresis of receivers
6-9
I_O/ signal (I/O)
4-49
input data latch (SIDL)
4-98
input filtering
6-8
instructions
block move
5-4
I/O
5-15
read/write
5-23
interface signals
3-13
interrupt enable one (SIEN1)
2-43
,
4-77
interrupt enable zero (SIEN0)
2-26
,
2-43
,
4-75
interrupt pending (SIP)
4-54
interrupt status one (SIST1)
2-42
,
2-43
,
2-46
,
2-47
,
4-81
interrupt status zero (SIST0)
2-26
,
2-42
,
2-43
,
2-46
,
2-47
,
4-
79
interrupts
2-46
isolation mode (ISO)
4-93
longitudinal parity (SLPAR)
4-82
loopback mode (SLB)
2-25
,
4-95
low level mode (LOW)
4-96
LVD Link
2-33
mode (SMODE[1:0])
4-99
MSG/ signal (MSG)
4-49
output control latch (SOCL)
4-40
output data latch (SODL)
2-51
,
2-52
,
2-53
,
4-100
parity control
2-27
parity error (PAR)
4-77
parity errors and interrupts
2-27
performance
1-6
phase
5-12
,
5-29
phase mismatch - initiator mode
4-75
registers
4-20
reset condition (RST)
4-77
RST/ received (RST)
4-81
RST/ signal (RST)
4-46
SCRIPTS operation
5-1
sample instruction
5-3
SDP0/ parity signal (SDP0)
4-46
SDP1/ parity signal (SDP1)
4-51
selected as ID (SSAID)
4-92
selector ID (SSID)
4-41
serial EEPROM access
2-57
status one (SSTAT1)
2-26
,
4-47
status two (SSTAT2)
2-26
,
4-49
status zero (SSTAT0)
2-26
,
4-45
synchronous offset maximum (SOM)
4-93
synchronous offset zero (SOZ)
4-92
synchronous transfer period (TP[2:0])
4-33
termination
2-37
test four (STEST4)
4-99
test one (STEST1)
4-93
test three (STEST3)
4-96
test two (STEST2)
2-25
,
4-94
test zero (STEST0)
4-92
timer one (STIME1)
4-88
timer zero (STIME0)
4-86
timing diagrams
6-58
TolerANT technology
1-5
transfer (SXFER)
2-40
,
4-33
true end of process
4-59
Ultra2 SCSI
2-21
valid (VAL)
4-41
wide residue (SWIDE)
2-52
,
4-84
SCSI high impedance mode (SZM)
4-95
SCSI-1
transfers
(differential 4.17 Mbytes)
6-60
(single-ended 5.0 Mbytes)
6-60
SCSI-2
fast transfers
10.0 Mbytes (8-bit transfers)
40 MHz Clock
6-61
50 MHz Clock
6-61
20.0 Mbytes (16-bit transfers)
40 MHz Clock
6-61
50 MHz Clock
6-61
second dword
5-14
,
5-22
,
5-24
,
5-33
,
5-36
,
5-39
select
2-18
during selection
2-38
instruction
5-17
with ATN/
5-21
with SATN/ on a start sequence (WATN)
4-24
selected (SEL)
2-44
,
4-76
,
4-79
selection or reselection time-out (STO)
4-78
,
4-82
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PDF描述
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