參數(shù)資料
型號(hào)： SII3114CTU
元件分類(lèi)： 總線控制器
英文描述： PCI BUS CONTROLLER, PQFP176
封裝： TQFP-176
文件頁(yè)數(shù)： 34/127頁(yè)
文件大小： 564K
代理商： SII3114CTU
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SiI3114 PCI to Serial ATA Controller
Data Sheet
Silicon Image, Inc.
SiI-DS-0103-D
6
2007 Silicon Image, Inc.
SATA Interface Transmitter Output Jitter Characteristics
Table 5. SATA Interface Transmitter Output Jitter Characteristics
Limits
Symbol
Parameter
Condition
Min
Typ
Max
Unit
RJ5UI
5UI later Random Jitter
Measured at Tx output pins
1sigma deviation
-
4.5
-
ps rms
RJ250UI
250UI later Random
Jitter
Measured at Tx output pins
1sigma deviation
-
6.0
-
ps rms
DJ5UI
5UI later Deterministic
Jitter
Measured at Tx output pins peak
to peak phase variation Random
data pattern
-
40
-
ps
DJ250UI
250UI later Deterministic
Jitter
Measured at Tx output pins peak
to peak phase variation Random
data pattern
-
45
-
ps
CLKI SerDes Reference Clock Input Requirements
Table 6. CLKI SerDes Reference Clock Input Requirements
Limits
Symbol
Parameter
Condition
Min
Typ
Max
Unit
TCLKI_FREQ
Nominal Frequency
REXT = 1k 1%
REXT = 4.99k 1%
-
25
100
-
MHz
VCLK_IH
Input High Voltage
-
0.7xVDDX
-
V
VCLK_IL
Input Low Voltage
-
0.3xVDDX
V
TCLKI_J
CLKI frequency tolerance
-
-100
+100
ppm
TCLKI_RISE_FALL Rise and Fall time at CLKI
25MHz reference clock,
20%-80%
100MHz reference clock,
20%-80%
-
4
2
ns
TCLKI_RC_DUTY
CLKI duty cycle
20%-80%
40
-
60
%
Notes:
CLKI must be 1.8V swing when external clock input to this pin
PCI 33 MHz Timing Specifications
Table 7. PCI 33 MHz Timing Specifications
Limits
Symbol
Parameter
Min
Max
Unit
TVAL
CLK to Signal Valid – Bussed Signals
2.0
11.0
ns
TVAL (PTP)
CLK to Signal Valid – Point to Point
2.0
11.0
ns
TON
Float to Active Delay
2.0
-
ns
TOFF
Active to Float Delay
-
28.0
ns
TSU
Input Setup Time – Bussed Signals
7.0
-
ns
TSU (PTP)
Input Setup Time – Point to Point
10.0
-
ns
TH
Input Hold Time
0.0
-
ns
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PDF描述
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