- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄361294 > QL8250 (Electronic Theatre Controls, Inc.) LOW POWER FPGA COMBINING PERFORMANCE DENSITY AND EMBEDED RAM PDF資料下載
參數(shù)資料
| 型號： | QL8250 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | LOW POWER FPGA COMBINING PERFORMANCE DENSITY AND EMBEDED RAM |
| 中文描述： | 低功耗FPGA配合力性能密度和嵌入式內(nèi)存 |
| 文件頁數(shù)： | 31/49頁 |
| 文件大?。?/td> | 739K |
| 代理商： | QL8250 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁當前第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁
Preliminary
6
&
*
,&&#
+
7
""'
+
<"'++
(
"
t
SID
(LVTTL)
LVTTL input delay: Low Voltage TTL for 3.3 V
applications
-
0.34 ns
t
SID
(LVCMOS2)
LVCMOS2 input delay: Low Voltage CMOS for 2.5 V
and lower applications
-
0.42 ns
t
SID
(LVCMOS18)
LVCMOS18 input delay: Low Voltage CMOS for 1.8
V applications
-
-
t
SID
(GTL+)
GTL+ input delay: Gunning Transceiver Logic
-
0.68 ns
t
SID
(SSTL3)
SSTL3 input delay: Stub Series Terminated Logic for
3.3 V
-
0.55 ns
t
SID
(SSTL2)
SSTL2 input delay: Stub Series Terminated Logic for
2.5 V
-
0.61 ns
PAD
OUTPUT
REGISTER
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| QL8325 | LOW POWER FPGA COMBINING PERFORMANCE DENSITY AND EMBEDED RAM |
| QL80FC-APB456C | Telecomm/Datacomm |
| QL80FC-APB456I | Telecomm/Datacomm |
| QL80FC-APQ208C | Telecomm/Datacomm |
| QL80FC-APQ208I | Telecomm/Datacomm |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| QL8250-6PQN208C-5690 | 制造商:QuickLogic Corporation 功能描述: |
| QL8250-6PQN208C-5691 | 制造商:QuickLogic Corporation 功能描述: |
| QL82SD | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
| QL82SD-PB516 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
| QL82SD-PQ208 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。