參數(shù)資料
型號(hào)： PSD813F5V-20MT
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 128K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQFP52
封裝： PLASTIC, QFP-52
文件頁(yè)數(shù)： 54/103頁(yè)
文件大?。?/td> 1180K
代理商： PSD813F5V-20MT
PSD8XXF2/3/4/5
54/103
Ports A and B – Functionality and Structure
Ports A and B have similar functionality and struc-
ture, as shown in Figure 25. The two ports can be
configured to perform one or more of the following
functions:
s
MCU I/O Mode
s
CPLD Output – Macrocells McellAB7-McellAB0
can be connected to Port A or Port B. McellBC7-
McellBC0 can be connected to Port B or Port C.
s
CPLD Input – Via the Input Macrocells (IMC).
s
Latched Address output – Provide latched
address output as per Table 21.
s
Address In – Additional high address inputs
using the Input Macrocells (IMC).
s
Open Drain/Slew Rate – pins PA3-PA0 and
PB3-PB0 can be configured to fast slew rate,
pins PA7-PA4 and PB7-PB4 can be configured
to Open Drain Mode.
s
Data Port – Port A to D7-D0 for 8 bit non-
multiplexed bus
s
Multiplexed Address/Data port for certain types
of MCU bus interfaces.
s
Peripheral Mode – Port A only
Figure 25. Port A and Port B Structure
INTERNAL
DATA
BUS
DATA OUT
REG.
DQ
D
G
Q
DQ
WR
ADDRESS
MACROCELL OUTPUTS
ENABLE PRODUCT TERM (.OE)
ALE
READ MUX
P
D
B
CPLD - INPUT
CONTROL REG.
DIR REG.
INPUT
MACROCELL
ENABLE OUT
DATA IN
OUTPUT
SELECT
OUTPUT
MUX
PORT
A OR B PIN
DATA OUT
ADDRESS
A[ 7:0] OR A[15:8]
AI02887
相關(guān)PDF資料
PDF描述
PSD853F2-15JIT 128K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQCC52
PSD833F2-15M 1M X 1 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQFP52
PSD835G2V-B-90MI Configurable Memory System on a Chip for 8-Bit Microcontrollers
PSD835G2V-B-90U Configurable Memory System on a Chip for 8-Bit Microcontrollers
PSD835G2V-B-90UI Configurable Memory System on a Chip for 8-Bit Microcontrollers
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參數(shù)描述
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