參數(shù)資料
型號： PSD813F5V-20MT
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 128K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQFP52
封裝： PLASTIC, QFP-52
文件頁數(shù)： 30/103頁
文件大?。?/td> 1180K
代理商： PSD813F5V-20MT
PSD8XXF2/3/4/5
32/103
Decode PLD (DPLD)
The DPLD, shown in Figure 12, is used for decod-
ing the address for internal and external compo-
nents. The DPLD can be used to generate the
following decode signals:
s
8 Sector Select (FS0-FS7) signals for the
primary Flash memory (three product terms
each)
s
4 Sector Select (CSBOOT0-CSBOOT3) signals
for the secondary Flash memory (three product
terms each)
s
1 internal SRAM Select (RS0) signal (two
product terms)
s
1 internal CSIOP Select (PSD Configuration
Register) signal
s
1 JTAG Select signal (enables JTAG on Port C)
s
2 internal Peripheral Select signals
(Peripheral I/O mode).
Figure 12. DPLD Logic Array
(INPUTS)
(24)
(8)
(16)
(1)
PDN (APD OUTPUT)
I /O PORTS (PORT A,B,C)
(8)
PGR0 - PGR7
(8)
MCELLAB.FB [7:0] (FEEDBACKS)
MCELLBC.FB [7:0] (FEEDBACKS)
A[15:0]
*
(3)
PD[2:0] (ALE,CLKIN,CSI)
CNTRL[2:0] (READ/WRITE CONTROL SIGNALS)
(1)
RESET
RD_BSY
RS0
CSIOP
PSEL0
PSEL1
8 PRIMARY FLASH
MEMORY SECTOR SELECTS
SRAM SELECT
I/O DECODER
SELECT
PERIPHERAL I/O MODE
SELECT
CSBOOT 0
CSBOOT 1
CSBOOT 2
CSBOOT 3
FS0
FS7
3
2
JTAGSEL
AI02873D
FS1
FS2
FS3
FS6
FS5
FS4
1
相關(guān)PDF資料
PDF描述
PSD853F2-15JIT 128K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQCC52
PSD833F2-15M 1M X 1 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQFP52
PSD835G2V-B-90MI Configurable Memory System on a Chip for 8-Bit Microcontrollers
PSD835G2V-B-90U Configurable Memory System on a Chip for 8-Bit Microcontrollers
PSD835G2V-B-90UI Configurable Memory System on a Chip for 8-Bit Microcontrollers
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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PSD813FH-90J 制造商:WSI 功能描述:
PSD813FN-15J 制造商:WSI 功能描述:
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