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參數(shù)資料
| 型號(hào)： | PSD813F2-15JT |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 128K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQCC52 |
| 封裝： | PLASTIC, LCC-52 |
| 文件頁(yè)數(shù)： | 56/103頁(yè) |
| 文件大小： | 1180K |
| 代理商： | PSD813F2-15JT |
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PSD8XXF2/3/4/5
56/103
Port D – Functionality and Structure
ure 28. This port does not support Address Out
mode, and therefore no Control Register is re-
quired. Port D can be configured to perform one or
more of the following functions:
s
MCU I/O Mode
s
CPLD Output – External Chip Select (ECS0-
ECS2)
s
CPLD Input – direct input to the CPLD, no Input
Macrocells (IMC)
s
Slew rate – pins can be set up for fast slew rate
Port D pins can be configured in PSDsoft Express
as input pins for other dedicated functions:
s
Address Strobe (ALE/AS, PD0)
s
CLKIN (PD1) as input to the macrocells flip-
flops and APD counter
s
PSD Chip Select Input (CSI, PD2). Driving this
signal High disables the Flash memory, SRAM
and CSIOP.
Figure 27. Port D Structure
INTERNAL
DATA
BUS
DATA OUT
REG.
DQ
WR
ECS[ 2: 0]
READ MUX
P
D
B
CPLD - INPUT
DIR REG.
DATA IN
ENABLE PRODUCT
TERM (.OE)
OUTPUT
SELECT
OUTPUT
MUX
PORT D PIN
DATA OUT
AI02889
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