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參數(shù)資料
| 型號(hào)： | PM2329 |
| 英文描述： | Telecommunication IC |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 79/162頁 |
| 文件大小： | 1581K |
| 代理商： | PM2329 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁當(dāng)前第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁
Proprietary and Confidential to PMC-Sierra, Inc and for its Customers
’
Internal Use
Document ID: PMC-2010146, Issue 4
82
PM2329 ClassiPI Network Classification Processor Datasheet
4.2.2.2 Rule Indirect Command Register (RICR; n008h)
Access Mode: Read/Write, Local
This register controls the indirect access mechanism to the Policy Database Rule Memory cells in the
PM2329.
The values in Rule Memory cells are accessed using the RIDR registers (explained in Section 4.2.2.4). The
diagram below shows the Policy Database Rule memory cell mapping to these (RIDR0~4) registers.
Figure 26 Access to Rule Memory Cells via RIDR0-4 Registers
Read/Write Data Enable
These bits enable or disable reading or writing to each of the 32-bit words comprising the 136-bit rule
memory. When a bit is
’
1
’
, read or write of the corresponding word is enabled. During write, the value in
the Rule Indirect Data Register will be written to the addressed rule memory location. When a bit is
’
0
’
,
the corresponding word is disabled. The higher bit (bit 12) is for Rule Indirect Data 0, and the lower bit
Bit
Range
63:13
12:8
7:6
5
4:2
1
0
Size
51
5
2
1
3
1
1
Name
Value after
Reset
Undefined
00h
Undefined
0
000
Undefined
1
(Reserved)
Read/Write Data Enable
(Reserved)
Auto-Increment
Trigger
(Reserved)
Register Set Ready (RO)
63
0
63
0
63
0
RD0
RD1
RD2
RD3
RD4
RD5
RC
135
104103
72 71
56 55
40 39 32 31 24 23
0
R
e
s
e
r
v
e
d
RIDR0
RIDR2
RIDR4
RD4
RIDRs
Rule
Rule
Memory
RD0
RD1
RD2
RD3
RC
RD5
R
e
s
e
r
v
e
d
R
e
s
e
r
v
e
d
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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