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參數(shù)資料
| 型號： | MTVX2602 |
| 廠商： | Zarlink Semiconductor Inc. |
| 英文描述： | Managed 24 Port 10/100 Mbps Ethernet Switch |
| 中文描述： | 管理的24端口10/100 Mbps以太網(wǎng)交換機(jī) |
| 文件頁數(shù)： | 84/147頁 |
| 文件大?。?/td> | 924K |
| 代理商： | MTVX2602 |
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MVTX2602
Data Sheet
84
Zarlink Semiconductor Inc.
13.6.4 AVPML – VLAN Tag Priority Map
I2C Address h0AD; CPU Address:h503
Accessed by CPU, serial interface and I2C (R/W)
Registers AVPML, AVPMM, and AVPMH allow the eight VLAN Tag priorities to map into eight Internal level transmit
priorities. Under the Internal transmit priority, seven is the highest priority where as zero is the lowest. This feature
allows the user the flexibility of redefining the VLAN priority field. For example, programming a value of 7 into bit 2:0
of the AVPML register would map packet VLAN priority 0 into Internal transmit priority 7. The new priority is used
inside the 2602. When the packet goes out it carries the original priority.
13.6.5 AVPMM – VLAN Priority Map
I2C Address h0AE, CPU Address:h504
Accessed by CPU, serial interface and I2C (R/W)
Map VLAN priority into eight level transmit priorities:
13.6.6 AVPMH – VLAN Priority Map
I2C Address h0AF, CPU Address:h505
Accessed by CPU, serial interface and I2C (R/W)
7
6
5
3
2
0
VP2
VP1
VP0
Bit [2:0]:
Priority when the VLAN tag priority field is 0
(Default 0)
Bit [5:3]:
Priority when the VLAN tag priority field is 1 (
Default 0)
Bit [7:6]:
Priority when the VLAN tag priority field is 2
(Default 0)
7
6
4
3
1
0
VP5
VP4
VP3
VP2
Bit [0]:
Priority when the VLAN tag priority field is 2
(Default 0)
Bit [3:1]:
Priority when the VLAN tag priority field is 3
(Default 0)
Bit [6:4]:
Priority when the VLAN tag priority field is 4
(Default 0)
Bit [7]:
Priority when the VLAN tag priority field is 5
(Default 0)
7
5
4
2
1
0
VP7
VP6
VP5
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MU456FC-RD | SUPER RED 0.56 FOUR DIGIT NUMERIC DISPLAYS |
| MU9C1480A-90DC | Content Addressable Memory |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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