參數(shù)資料
型號： MCHC908RK2CSDR2
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 4 MHz, MICROCONTROLLER, PDSO20
封裝： PLASTIC, SSOP-20
文件頁數(shù)： 15/181頁
文件大?。?/td> 2384K
代理商： MCHC908RK2CSDR2
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Input/Output (I/O) Ports
Port A
MC68HC908RK2 — Rev. 5.0
Data Sheet
MOTOROLA
Input/Output (I/O) Ports
111
9.2.2 Data Direction Register A
Data direction register A (DDRA) determines whether each port A pin is an input or
an output. Writing a 1 to a DDRA bit enables the output buffer for the corresponding
port A pin; a 0 disables the output buffer.
DDRA[7:0] — Data Direction Register A Bits
These read/write bits control port A data direction. Reset clears DDRA[7:0],
configuring all port A pins as inputs.
1 = Corresponding port A pin configured as output
0 = Corresponding port A pin configured as input
NOTE:
Avoid glitches on port A pins by writing to the port A data register before changing
data direction register A bits from 0 to 1.
Figure 9-4 shows the port A I/O logic.
When bit DDRAx is a 1, reading address $0000 reads the PTAx data latch. When
bit DDRAx is a 0, reading address $0000 reads the voltage level on the pin. The
data latch can always be written, regardless of the state of its data direction bit.
Table 9-1 summarizes the operation of the port A pins.
Figure 9-4. Port A I/O Circuit
Address:
$0004
Bit 7
654321
Bit 0
Read:
DDRA7
DDRA6
DDRA5
DDRA4
DDRA3
DDRA2
DDRA1
DDRA0
Write:
Reset:
00000000
Figure 9-3. Data Direction Register A (DDRA)
READ DDRA ($0004)
WRITE DDRA ($0004)
RESET
WRITE PTA ($0000)
READ PTA ($0000)
DDRAx
PTAx
INT
ERNAL
D
AT
A
B
U
S
PTAx
VDD
KBIEX
INTERNAL
PULLUP
DEVICE
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