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參數(shù)資料
| 型號： | MC9RS08KA1CSCR |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 77/136頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 8-BIT 1K FLASH 8-SOIC |
| 產(chǎn)品培訓模塊： | Mechatronics USBSpyder08 Discovery Kit RS08KA2 Low-End Microcontroller Series MC9RS08KA8 Microcontroller |
| 標準包裝： | 1 |
| 系列： | RS08 |
| 核心處理器： | RS08 |
| 芯體尺寸： | 8-位 |
| 速度： | 10MHz |
| 外圍設備： | LVD，POR，WDT |
| 輸入/輸出數(shù)： | 4 |
| 程序存儲器容量： | 1KB（1K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 63 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 包裝： | 標準包裝 |
| 產(chǎn)品目錄頁面： | 726 (CN2011-ZH PDF) |
| 其它名稱： | MC9RS08KA1CSCRDKR |
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MC9RS08KA2 Series Data Sheet, Rev. 4
Freescale Semiconductor
45
Chapter 6
Parallel Input/Output Control
This section explains software controls related to parallel input/output (I/O) and pin control. The
MC9RS08KA2 Series has one parallel I/O port, which includes two I/O pins in the 6-pin package or four
I/O pins in the 8-pin packages, one output-only pin, and one input-only pin. See Chapter 2, “Pins and
Connections,” for more information about pin assignments and external hardware considerations for these
pins.
All of these I/O pins are shared with on-chip peripheral functions as shown in Table 2-1. The peripheral
modules have priority over the I/Os so that when a peripheral is enabled, the I/O functions associated with
the shared pins are disabled. After reset, the shared peripheral functions are disabled so that the pins are
controlled by the I/O. All of the I/Os are configured as inputs (PTADDn = 0) with pullup/pulldown devices
disabled (PTAPEn = 0), except for output-only pin PTA3, which defaults to the BKGD/MS function.
Reading and writing of parallel I/Os is performed through the port data registers. The direction, either input
or output, is controlled through the port data direction registers. The parallel I/O port function for an
individual pin is illustrated in the block diagram shown in Figure 6-1.
Figure 6-1. Parallel I/O Block Diagram
The data direction control bit (PTADDn) determines whether the output buffer for the associated pin is
enabled, and also controls the source for port data register reads. The input buffer for the associated pin is
always enabled unless the pin is enabled as an analog function or is an output-only pin.
Q
D
Q
D
1
0
Port Read
PTADDn
PTADn
Output Enable
Output Data
Input Data
Synchronizer
Data
BUSCLK
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MC9S12HZ64CAA | IC MCU 16BIT 64K FLASH 80-QFP |
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| MC908MR8MPE | IC MCU 8BIT 8K FLASH 28-PDIP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC9RS08KA1DB | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9RS08KA1PC | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9RS08KA1SC | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9RS08KA2 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9RS08KA2_07 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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