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參數(shù)資料
| 型號： | MC68MH360ZQ33LR2 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 49/158頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU QUICC 33MHZ 357-PBGA |
| 標準包裝： | 180 |
| 系列： | M683xx |
| 處理器類型： | M683xx 32-位 |
| 速度： | 33MHz |
| 電壓： | 5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 357-BBGA |
| 供應(yīng)商設(shè)備封裝： | 357-PBGA（25x25） |
| 包裝： | 帶卷 (TR) |
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QMC Supplement
Figure C-4. FSC Generation from a 2.048-MHz Clock—Block
Diagram
Figure C-5. FSC Generation from a 2.048-MHz Clock—Timing
The S/T interface includes elastic buffers allowing continued operation under any phase
relationship between the IDL frame sync and the network. These buffers allow the frame
sync to wander with respect to the network up to 60
s peak-to-peak, exceeding the Q.502
requirements of 18
s peak-to-peak over a 24-hour period.
Figure C-6 shows a block diagram of the connection between four S/T interfaces and the
QUICC32. The diagram would be the same for up to 10 S/T interfaces.
256 Divider
Duty cycle
of 50%
2.048-MHz
8-KHz Clock
Duty cycle 50%
D
CLK
Q
D
CLK
Q
FSC
2.048-MHz
2.048-MHz
Flip-op 1
Flip-op 2
Clock
8-KHz Clock
2.048-MHz
Q Flip-op 1
Q Flip-op 2
FSC
8 KHz
Inverted Clock
Clock
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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