參數(shù)資料
型號(hào)： MB91F467PAPMC-GSE2
廠商： FUJITSU LTD
元件分類： 微控制器/微處理器
英文描述： RISC MICROCONTROLLER, PQFP176
封裝： 24 X 24 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-176
文件頁數(shù)： 145/200頁
文件大小： 6566K
代理商： MB91F467PAPMC-GSE2
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MB91460P Series
DS07-16615-2E
49
[bit 5] S10
This bit defines resolution of A/D conversion. If this bit set "0", the resolution is 10-bit. In the other case, resolution
is 8-bit and the conversion result is stored to ADCR0 and in the lower 8 bits of the dedicated ADC result registers.
Initialized to "0" by a reset.
[bit 4 to 0] ACH4-0 (Analog convert select channel, read-only)
These bits show the number of the currently or previously converted analog channel, depending on bit ACHMD
(see below).
Writing these bits has no effect (bit 0 is writable with special function ADCHMD).
Initialized to "0000" by software reset (RST).
[bit 0] ACHMD (ACH register mode, write-only)
For reading out the ACH4-0 register bits (see below), there is a direct mode and a latched mode.
In direct mode, ACH4-0 shows the number of the ADC channel which is currently in conversion, e.g. the internal
conversion channel pointer. This pointer is incremented immediately after a conversion is finished.
In latched mode, ACH4-0 shows the number of the ADC channel whose conversion was finished previously.
After a conversion is finished, the conversion channel pointer is latched and the latched data can be read in this
mode. At the end of the next conversion, the latch is overwritten if no PAUSE condition exists.
ACHMD is a write-only bit.
Read- or read-modify-write access returns the value of bit ACH0, see below.
Initial value is 0.
ACH4
ACH3
ACH2
ACH1
ACH0
Converted channel
00000
AN0
00001
AN1
...
11110
AN30
11111
AN31
ACHMD
Function
0
Direct ACH register mode [Initial value]
1
Latched ACH register mode
相關(guān)PDF資料
PDF描述
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MB91F467TAPMC-GSE2 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PQFP144
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參數(shù)描述
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MB91F467RDPMC-ESE2 制造商:FUJITSU 功能描述:
MB91F467RDPMC-GSE2 制造商:FUJITSU 功能描述:
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