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參數(shù)資料
| 型號(hào)： | MB91F467PAPMC-GSE2 |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | RISC MICROCONTROLLER, PQFP176 |
| 封裝： | 24 X 24 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-176 |
| 文件頁數(shù)： | 143/200頁 |
| 文件大?。?/td> | 6566K |
| 代理商： | MB91F467PAPMC-GSE2 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁當(dāng)前第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁
MB91460P Series
DS07-16615-2E
47
[bit 12] PAUS (A/D converter pause)
This bit is set when A/D conversion temporarily halts.
The A/D converter has one register to store the conversion result (ADCR) and additionally 32 ADC channel data
registers. If a conversion is finished and the data of the previous conversion has not been read out before,
previous data would be overwritten.
To avoid this problem, the next conversion data is not stored in the data registers until the previous value has
been read out (e.g. by DMA). A/D conversion halts during this time. A/D conversion resumes when the ADC
interrupt flag ADCR1.INT is cleared.
The register protection function depends on the conversion mode and the setting of ADCR2.INTE2:
In continuous mode with INTE2==1, PAUS is set when data of the start channel (set by ADSCH) is ready for
writing to the registers, but IRQ2 (End of Scan interrupt) is active.
In the other modes or if INTE2==0, PAUS is set when data of any channel is ready for writing to the registers,
but IRQ (End of Conversion) is active.
PAUS is cleared by writing "0" or by a reset. (Not cleared at the end of DMA transfer.) However when waiting
condition of DMA transfer, this bit cannot be cleared.
Regarding protect function of converted data, see Section “6. Operation of A/D Converter".
[bit 11, 10] STS1, STS0 (Start source select)
These bits select the A/D activation source.
These bits are initialized "00" by software reset (RST).
In multiple-activation modes, the first activation to occur starts A/D conversion.
The activation source changes immediately on writing to the register. Therefore care is required when switching
activation mode during A/D operation.
The A/D converter detects falling edges on the external trigger pin. When external trigger level is "L" and if
these bits are changed to external trigger activation mode, A/D converting may starts.
Selecting the timer selects the 16-bit reload timer 7.
Mode
INTE2
Function
Single,
Stop
X
Protect ADCR (the common result register)
Continuous
0
Protect ADCR (the common result register)
1
Protect ADCD0...ADCD31 (the dedicated channel data registers)
STS1
STS0
Function
0
Software activation [Initial value]
0
1
External trigger pin activation and software activation
1
0
Timer activation and software activation
1
External trigger pin activation, timer activation and software activation
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
| MB91F467R | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit Microcontroller |
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