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參數(shù)資料
| 型號(hào)： | L6701TR |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 3 Phase Controller for VR10, VR9 and K8 CPUs |
| 中文描述： | 3 VR10，VR9和K8處理器相控制器 |
| 文件頁數(shù)： | 27/44頁 |
| 文件大?。?/td> | 492K |
| 代理商： | L6701TR |
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L6701
11 Dynamic VID Transitions
27/44
Caution:
If the new VID code is more than 1 LSB different from the previous, the device will execute the
transition stepping the reference with the DVID-clock frequency F
DVID
until the new code has
reached: for this reason it is recommended to carefully control the VID change rate in order to
carefully control the slope of the output voltage variation especially in VR10 mode.
Warning:
DVID sample and hold clock depends on the switching frequency F
SW
. To correctly perform
DVID transition so following the VID change rate, it is required to have at least 2 complete
cycles of the F
DVID
clock between every VID transition. If the VID update-rate is, for example,
5
μ
sec., the minimum operating frequency results to be F
SW
> 133kHz in VR10 mode.
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PDF描述 |
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參數(shù)描述 |
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