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參數資料
| 型號： | FT2232C |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | FT2232C Dual USB UART / FIFO I.C. |
| 中文描述： | FT2232C雙USB的UART / FIFO的集成電路 |
| 文件頁數： | 43/51頁 |
| 文件大?。?/td> | 907K |
| 代理商： | FT2232C |
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DS2232C Version 1.4
Future Technology Devices International Ltd. 2005 Page 43 of 54
FT2232C Dual USB UART / FIFO I.C.
Figure 29 - MCU Host Bus Emulation Mode Signal Timing - Write Cycle
OSC
A15..A8
AD7..0
ALE
CS#
WR#
High Address
Low Address
Data
t1
t2
t3
t4
t5
t6
t7
t8
t9 t10
t11
IORDY
Time
t1
t2
t3
t4
t5
t6
t7
t8
t9
t10
t11
Description
High address byte is placed on the bus if the extended write is used.
Low address byte is put out.
1 clock period for address is set up.
ALE goes high to enable latch. This will extend to 2 clocks wide if IORDY is low.
ALE goes low to latch address and CS# is set active low.
Data driven onto the bus.
1 clock period for data setup.
WR# is driven active low. This will extend to 6 clocks wide if IORDY is low.
WR# is driven inactive high.
CS# is driven inactive, 1/2 a clock period after WR# goes inactive
Data is held until this point, and may now change
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PDF描述 |
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| FT2232D-TRAY | 制造商:Future Technology Devices International (FTDI Chip) 功能描述:DUAL USB TO SERIAL UART/FIFO IC |
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