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參數(shù)資料
| 型號： | FDC37B80X |
| 廠商： | STANDARD MICROSYSTEMS CORP |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | PC98/99 Compliant Enhanced Super I/O Controller with Keyboard/Mouse Wake-Up |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP100 |
| 封裝： | QFP-100 |
| 文件頁數(shù)： | 61/194頁 |
| 文件大?。?/td> | 802K |
| 代理商： | FDC37B80X |
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61
Sense Drive Status
Sense Drive Status obtains drive status
information. It has not execution phase and
goes directly to the result phase from the
command phase. Status Register 3 contains
the drive status information.
Specify
The Specify command sets the initial values for
each of the three internal times. The HUT
(Head Unload Time) defines the time from the
end of the execution phase of one of the
read/write commands to the head unload state.
The SRT (Step Rate Time) defines the time
interval between adjacent step pulses. Note that
the spacing between the first and second step
pulses may be shorter than the remaining step
pulses. The HLT (Head Load Time) defines the
time between when the Head Load signal goes
high and the read/write operation starts. The
values change with the data rate speed selection
and are documented in Table 27. The values
are the same for MFM and FM.
Table 27 - Drive Control Delays (ms)
HUT
500K
300K
250K
256
16
..
224
240
400
480
SRT
2M
64
4
..
56
60
1M
128
8
..
112
120
2M
4
3.75
..
0.5
0.25
1M
8
7.5
..
1
0.5
500K
16
15
..
2
1
300K
26.7
25
..
3.33
1.67
250K
32
30
..
4
2
0
1
..
E
F
426
26.7
..
373
512
32
..
448
HLT
2M
64
0.5
1
..
63
63.5
1M
128
1
2
..
126
127
500K
256
2
4
..
252
254
300K
426
3.3
6.7
..
420
423
250K
512
4
8
.
504
508
00
01
02
..
7F
7F
The choice of DMA or non-DMA operations is made by the ND bit. When this bit is "1", the non-DMA
mode is selected, and when ND is "0", the DMA mode is selected. In DMA mode, data transfers are
signaled by the FDRQ pin. Non-DMA mode uses the RQM bit and the FINT pin to signal data
transfers.
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