參數(shù)資料
型號: FDC37B80X
廠商: STANDARD MICROSYSTEMS CORP
元件分類: 外設(shè)及接口
英文描述: PC98/99 Compliant Enhanced Super I/O Controller with Keyboard/Mouse Wake-Up
中文描述: MULTIFUNCTION PERIPHERAL, PQFP100
封裝: QFP-100
文件頁數(shù): 136/194頁
文件大?。?/td> 802K
代理商: FDC37B80X
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Table 54 - Chip Level Registers
REGISTER
OSC
ADDRESS
0x24 R/W
DESCRIPTION
STATE
C
Default = 0x04, on
Vcc POR or
Reset_Drv hardware
signal.
Bit[0] Reserved
Bit [1] PLL Control
= 0
PLL is on (backward Compatible)
= 1
PLL is off
Bits[3:2] OSC
= 01
Osc is on, BRG clock is on.
= 10
Same as above (01) case.
= 00
Osc is on, BRG Clock Enabled.
= 11
Osc is off, BRG clock is disabled.
Bit [5:4] Reserved, set to zero
Bit [6] 16-Bit Address Qualification
= 0
12-Bit Address Qualification
= 1
16-Bit Address Qualification
Bit[7] Reserved
Reserved - Writes are ignored, reads return 0.
Chip Level
Vendor Defined
Configuration
Address Byte 0
0x25
Default
=0
x
F0 (Sysopt=0)
=0
x
70 (Sysopt=1)
on Vcc POR or
Reset_Drv
Configuration
Address Byte 1
0x26
Bit[7:1] Configuration Address Bits [7:1]
Bit[0] = 0
See Note 1
C
Default = 0x03
on Vcc POR or
Reset_Drv
Default = 0x00
on VCC POR and
Hard Reset
Chip Level
Vendor Defined
TEST 4
0x27
Bit[7:0] Configuration Address Bits [15:8]
See Note 1
C
0x28
Bits[7:0] Reserved - Writes are ignored, reads
return 0.
0x29 -0x2A
Reserved - Writes are ignored, reads return 0.
Default = 0x00, on
Vcc POR
0x2B R/W
Test Modes: Reserved for SMSC. Users should not
write to this register, may produce undesired
results.
C
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