參數(shù)資料
型號(hào): FDC37B80X
廠商: STANDARD MICROSYSTEMS CORP
元件分類: 外設(shè)及接口
英文描述: PC98/99 Compliant Enhanced Super I/O Controller with Keyboard/Mouse Wake-Up
中文描述: MULTIFUNCTION PERIPHERAL, PQFP100
封裝: QFP-100
文件頁(yè)數(shù): 134/194頁(yè)
文件大?。?/td> 802K
代理商: FDC37B80X
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134
Chip Level (Global) Control/Configuration
Registers[0x00-0x2F]
The chip-level (global) registers lie in the
address range [0x00-0x2F]. The design MUST
use all 8 bits of the ADDRESS Port for register
selection. All unimplemented registers and bits
ignore writes and return zero when read.
The INDEX PORT is used to select a
configuration register in the chip. The DATA
PORT is then used to access the selected
register. These registers are accessible only in
the Configuration Mode.
Table 53 - Chip Level Registers
REGISTER
ADDRESS
DESCRIPTION
STATE
Chip (Global) Control Registers
Reserved - Writes are ignored, reads return 0.
0x00 -
0x01
0x02 W
Config Control
Default = 0x00
on Vcc POR or
Reset_Drv
Index Address
The hardware automatically clears this bit after the
write, there is no need for software to clear the bits.
Bit 0 = 1: Soft Reset. Refer to the "Configuration
Registers" table for the soft reset value for each
register.
C
Default = 0x03
on Vcc POR or
Reset_Drv
0x03 R/W
Bit[7]
= 1
Enable WDT_CTRL and SMI Enable and
SMI Status Register access when not in
configuration mode
Disable WDT_CTRL and SMI Enable and
SMI Status Register access when not in
configuration mode (Default)
= 0
Bits [6:2]
Reserved - Writes are ignored, reads return 0.
Bits[1:0]
Sets GP index register address when in Run mode
(not in Configuration Mode).
= 11 0xEA (Default)
= 10 0xE4
= 01 0xE2
= 00 0xE0
Reserved - Writes are ignored, reads return 0
.
0x04 - 0x06
Logical Device #
Default = 0x00
on Vcc POR or
Reset_Drv
0x07 R/W
A write to this register selects the current logical
device. This allows access to the control and
configuration registers for each logical device.
Note: The Activate command operates only on the
selected logical device.
C
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