參數(shù)資料
型號： EP2S60F1020C5N
廠商： Altera
文件頁數(shù)： 638/768頁
文件大?。?/td> 0K
描述： IC STRATIX II FPGA 60K 1020-FBGA
產(chǎn)品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 6
系列： Stratix® II
LAB/CLB數(shù)： 3022
邏輯元件/單元數(shù)： 60440
RAM 位總計： 2544192
輸入/輸出數(shù)： 718
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1020-BBGA
供應(yīng)商設(shè)備封裝： 1020-FBGA（33x33）
配用： 544-1700-ND - DSP KIT W/STRATIX II EP2S60N
544-1697-ND - NIOS II KIT W/STRATIX II EP2S60N
其它名稱： 544-1902
EP2S60F1020C5N-ND
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Altera Corporation
8–13
January 2008
Stratix II Device Handbook, Volume 2
Remote System Upgrades with Stratix II and Stratix II GX Devices
When the remote system upgrade circuitry detects an external
configuration reset (nCONFIG pulsed low) or internal configuration reset
(logic array nCONFIG assertion), the device attempts to reload the
application configuration from page one.
Figure 8–5 shows the transitions between configurations in local update
mode.
Figure 8–5. Transitions Between Configurations in Local Update Mode
Stratix II and Stratix II GX FPGAs support local update mode in the FPP,
PS, and PPA configuration schemes. In these schemes, the MAX II device,
microprocessor, or enhanced configuration device should sample the
PGM[2..0]
outputs from the Stratix II or Stratix II GX FPGA and
transmit the appropriate configuration image.
Local update mode is not supported with the AS configuration scheme,
(or serial configuration device), because the Stratix II or Stratix II GX
FPGA cannot determine the start address of the application configuration
page upon power up. While the factory configuration is always located at
memory address 0x000000, the application configuration can be located
at any other sector boundary within the serial configuration device. The
start address depends on the size of the factory configuration and is user
selectable. Hence, only remote update mode is supported in the AS
configuration scheme.
Application
Configuration
(Page 001)
Core or External
nCONFIG Assertion
Configuration
Error
Core or External
nCONFIG Assertion
Power Up or nCONFIG assertion
Factory
Configuration
(Page 000)
Configuration
Error
相關(guān)PDF資料
PDF描述
AGM36DTBD CONN EDGECARD 72POS R/A .156 SLD
EP1S30F1020C7 IC STRATIX FPGA 30K LE 1020-FBGA
DS1230YP-70IND+ IC NVSRAM 256KBIT 70NS 34PCM
EP1SGX25DF1020C7 IC STRATIX GX FPGA 25K 1020-FBGA
DS1225AB-70IND+ IC NVSRAM 64KBIT 70NS 28DIP
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
EP2S60F1020I4 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 3022 LABs 718 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S60F1020I4N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 3022 LABs 718 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S60F484C3 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 3022 LABs 334 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S60F484C3N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 3022 LABs 334 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S60F484C4 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 3022 LABs 334 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
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