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參數(shù)資料
| 型號(hào)： | DS33ZH11+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 151/172頁 |
| 文件大小： | 0K |
| 描述： | IC MAPPER ETHERNET 100CSBGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 7 |
| 應(yīng)用： | 數(shù)據(jù)傳輸 |
| 接口： | 串行 |
| 電源電壓： | 1.8V，2.5V，3.3V |
| 封裝/外殼： | 100-LFBGA，CSPBGA |
| 供應(yīng)商設(shè)備封裝： | 100-CSBGA（10x10） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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DS33Z11 Ethernet Mapper
8 of 172
2 FEATURE HIGHLIGHTS
2.1 General
169-pin CSBGA package (DS33Z11)
100-pin CSBGA package for hardware/SPI modes only (DS33ZH11)
1.8V supply with 3.3V tolerant inputs and outputs
IEEE 1149.1 JTAG boundary scan
Software access to device ID and silicon revision
Development support includes evaluation kit, driver source code, and reference designs
2.2 Serial Interface
Supports line speeds up to 52 Mbps
Supports data enable and gapped clocking
Supports byte synchronization input and output for X.86 applications
2.3 HDLC
One HDLC controller engine
Compatible with polled or interrupt driven environments
Programmable FCS insertion and extraction
Programmable FCS type
Supports FCS error insertion
Programmable packet size limits (minimum 64 bytes and maximum 2016 bytes)
Supports bit stuffing/destuffing
Selectable packet scrambling/descrambling (X
43 + 1)
Separate FCS errored packet and aborted packet counts
Programmable inter-frame fill for transmit HDLC
2.4 Committed Information Rate (CIR) Controller
CIR rate controller limits transmission of data from the Ethernet interface to the serial interface
CIR granularity at 512 kbps
CIR Averaging for smoothing traffic peaks
2.5 X.86 Support
Programmable X.86 address/control fields for transmit and receive
Programmable 2-byte protocol (SAPI) field for transmit and receive
32 bit FCS
Transmit Transparency processing—7E is replaced by 7D, 5E
Transmit Transparency processing—7D replaced by 7D, 5D
Receive rate adaptation (7D, DD) is deleted
Receive Transparency processing—7D, 5E is replaced by 7E
Receive Transparency processing—7D, 5D is replaced by 7D
Receive Abort Sequence the LAPS packet is dropped if 7D7E is detect
Self-synchronizing X
43 + 1 payload scrambling.
Frame indication due to bad address/control/SAPI, FCS error, abort sequence, or frame size longer
than preset max
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DS33ZH11+ | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC 10/100 ENETXPORT HMODE MAP IND RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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| DS3404FP000 | 制造商:Thomas & Betts 功能描述:30A,PLG,3P4W,MG,404,3P480V |
| DS3404FP000/JG63 | 制造商:Thomas & Betts 功能描述:30A,CON,3P4W,MG,404,3P480V,JG63,SC |
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