Table 9-2, Table 9-3
參數(shù)資料
型號： DS33ZH11+
廠商： Maxim Integrated Products
文件頁數(shù)： 137/172頁
文件大?。?/td> 0K
描述： IC MAPPER ETHERNET 100CSBGA
產品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 7
應用： 數(shù)據傳輸
接口： 串行
電源電壓： 1.8V，2.5V，3.3V
封裝/外殼： 100-LFBGA，CSPBGA
供應商設備封裝： 100-CSBGA（10x10）
包裝： 托盤
安裝類型： 表面貼裝
DS33Z11 Ethernet Mapper
67 of 172
9.1 Register Bit Maps
Table 9-2, Table 9-3, Table 9-4, Table 9-5, Table 9-6, and Table 9-7 contain the registers of the DS33Z11. Bits
that are reserved are noted with a single dash “-“. All registers not listed are reserved and should be initialized
with a value of 00h for proper operation, unless otherwise noted.
9.1.1 Global Register Bit Map
Table 9-2 Global Register Bit Map
ADDR
Name
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
00h
GL.IDRL
ID07
ID06
ID05
ID04
ID03
ID02
ID01
ID00
01h
GL.IDRH
ID15
ID14
ID13
ID12
ID11
ID10
ID09
ID08
02h
GL.CR1
-
REF_CLKO
INTM
RST
03h
GL.BLR
-
GL.BLC1
04h
GL.RTCAL
-
RLCALS1
-
TLCALS1
05h
GL.SRCALS
-
REFCLKS
SYSCLS
06h
GL.LIE
-
LIN1TIE
-
LIN1RIE
07h
GL.LIS
-
LIN1TIS
-
LIN1RIS
08h
GL.SIE
-
SUB1IE
09h
GL.SIS
-
SUB1IS
0Ah
GL.TRQIE
-
TQ1IE
-
RQ1IE
0Bh
GL.TRQIS
-
TQ1IS
-
RQ1IS
0Ch
GL.BIE
-
BIE
0Dh
GL.BIS
-
BIS
0Eh
GL.CON1
-
LINE0
0Fh
Reserved
-
10h
Reserved
-
11h
Reserved
-
12h
GL.C1QPR
-
C1MRPRR
C1HWPRR
C1MHPR
C1HRPR
13h
Reserved
-
14h
Reserved
-
15h
Reserved
-
20h
GL.BISTEN
-
BISTE
21h
GL.BISTPF
-
BISTDN
BISTPF
03Ah
GL.SDMODE1
-
WT
BL2
BL1
BL0
03Bh
GL.SDMODE2
-
LTMOD2
LTMOD1
LTMOD0
03Ch
GL.SDMODEWS
-
SDMW
03Dh
GL.SDRFTC
SREFT7
SREFT6
SREFT5
SREFT4
SREFT3
SREFT2
SREFT1
SREFT0
All address locations not listed are reserved.
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PDF描述
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