參數(shù)資料
型號(hào)： DS3174N
英文描述： Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers
中文描述： 單/雙/三/四DS3/E3單芯片收發(fā)器
文件頁(yè)數(shù)： 172/232頁(yè)
文件大?。?/td> 2133K
代理商： DS3174N
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DS3171/DS3172/DS3173/DS3174
172 of 232
12.8.2.1 Register Bit Descriptions
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
Bit #
Name
Default
Bit 3: Receive Multi-frame Alignment Disable (RMAD)
– When 0, multi-frame alignment is performed. When 1,
multi-frame alignment is disabled and the trail trace bytes are stored starting with a random byte.
TT.RCR
Trail Trace Receive Control Register
(0,2,4,6)F0h
15
--
0
14
--
0
13
--
0
12
--
0
11
--
0
10
--
0
9
--
0
8
--
0
7
--
0
6
--
0
5
4
3
2
1
0
Reserved
0
Reserved
0
RMAD
0
RETCE
0
RDIE
0
RBRE
0
Bit 2: Receive Expected Trail Trace Comparison Enable (RETCE)
– When 0, expected trail trace comparison is
disabled. When 1, expected trail trace comparison is performed. Note: When the RMAD bit is one, expected trail
trace comparison is disabled regardless of the setting of this bit.
Bit 1: Receive Data Inversion Enable (RDIE)
– When 0, the incoming data is directly passed on for trail trace
processing. When 1, the incoming data is inverted before being passed on for trail trace processing.
Bit 0: Receive Bit Reordering Enable (RBRE)
– When 0, bit reordering is disabled (The first bit received is the
MSB
TT.RIR
.RTD[7] of the byte). When 1, bit reordering is enabled (The first bit received is the LSB
TT.RIR
.RTD[0] of the byte).
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
Bit #
Name
Default
Bits 11 to 8: Expected Trail Trace Identifier Address (ETIA[3:0])
– These four bits indicate the expected trail
trace identifier byte to be read/written by the next memory access. Address 0h indicates the first byte of the
expected trail trace identifier. Note: The value of these bits increments with each expected trail trace identifier
memory access (when these bits are Fh, a memory access will return them to 0h).
TT.RTIAR
Trail Trace Receive Identifier Address Register
(0,2,4,6)F2h
15
--
0
14
--
0
13
12
11
10
9
8
Reserved
0
Reserved
0
ETIA3
0
ETIA2
0
ETIA1
0
ETIA0
0
7
--
0
6
--
0
5
4
3
2
1
0
Reserved
0
Reserved
0
RTIA3
0
RTIA2
0
RTIA1
0
RTIA0
0
Bits 3 to 0: Receive Trail Trace Identifier Address (RTIA[3:0])
– These four bits indicate the receive trail trace
identifier byte to be read by the next memory access. Address 0h indicates the first byte of the receive trail trace
identifier. Note: The value of these bits increments with each received trail trace identifier memory access (when
these bits are Fh, a memory access will return them to 0h).
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PDF描述
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DS319 Two-Way Power Divider 10500 MHz
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參數(shù)描述
DS3174N+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad DS3/E3 Single Chip Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3177+ 制造商:Maxim Integrated Products 功能描述:IC TXRX DS3/E3 CSBGA
DS3177N+ 制造商:Maxim Integrated Products 功能描述:DS3/E3 SINGLE-CHIP TRANSCEIVER - Rail/Tube 制造商:Maxim Integrated Products 功能描述:IC TXRX DS3/E3 CSBGA
DS3177N+T 制造商:Maxim Integrated Products 功能描述:DS3/E3 SINGLE-CHIP TRANSCEIVER - Tape and Reel
DS-318 制造商:MA-COM 制造商全稱:M/A-COM Technology Solutions, Inc. 功能描述:Plug-In Two-Way Power Divider, 5 - 500 MHz
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