參數(shù)資料
型號： DS3174N
英文描述： Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers
中文描述： 單/雙/三/四DS3/E3單芯片收發(fā)器
文件頁數(shù)： 143/232頁
文件大?。?/td> 2133K
代理商： DS3174N
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DS3171/DS3172/DS3173/DS3174
143 of 232
Bit 1 : RCLKOn / RGCLKn Invert (RCLKOI).
This bit inverts the RCLKOn / RGCLKn pin when set.
Register Name:
Register Description:
Register Address:
Bit #
Name
Bit #
Name
PORT.ISR
Port Interrupt Status Register
(0,2,4,6)50h
15
--
7
14
--
6
FSR
13
--
5
HSR
12
--
4
BSR
11
--
3
10
--
2
9
8
PSR
1
RESERVED
LCSR
0
FMSR
TTSR
RESERVED
RESERVED
Bit 9: Port Status Register Interrupt Status (PSR)
This bit is set when any of the latched status register bits, that
are enabled for interrupt, in the
PORT.SRL
register are set. The interrupt pin will be driven when this bit is set and
the corresponding
GL.ISRIE
.PISRIE[4:1] is set.
Bit 8: Line Code Status Register Interrupt Status (LCSR)
This bit is set when any of the latched status register
bits, that are enabled for interrupt, in the B3ZS/HDB3 Line Encoder/Decoder block are set. The interrupt pin will be
driven when this bit is set and the corresponding
GL.ISRIE
.PISRIE[4:1] is set.
Bit 7: Trail Trace Status Register Interrupt Status (TTSR)
This bit is set when any of the latched status register
bits, that are enabled for interrupt, in the trail trace block are set. The interrupt pin will be driven when this bit is set
and the corresponding
GL.ISRIE
.PISRIE[4:1] is set.
Bit 6: FEAC Status Register Interrupt Status (FSR)
This bit is set when any of the latched status register bits,
that are enabled for interrupt, in the FEAC block are set. The interrupt pin will be driven when this bit is set and the
corresponding
GL.ISRIE
.PISRIE[4:1] is set.
Bit 5: HDLC Status Register Interrupt Status (HSR)
This bit is set when any of the latched status register bits,
that are enabled for interrupt, in the HDLC block are set. The interrupt pin will be driven when this bit is set and the
corresponding
GL.ISRIE
.PISRIE[4:1] is set.
Bit 4: BERT Status Register Interrupt Status (BSR)
This bit is set when any of the latched status register bits,
that are enabled for interrupt, in the BERT block are set. The interrupt pin will be driven when this bit is set and the
corresponding
GL.ISRIE
.PISRIE[4:1] is set.
Bit 0: Framer Status Register Interrupt Status (FMSR)
This bit is set when any of the latched status register bits,
that are enabled for interrupt, in the active DS3 or E3 framer block are set. The interrupt pin will be driven when this
bit is set and the corresponding
GL.ISRIE
.PISRIE[4:1] is set.
Register Name:
Register Description:
Register Address:
Bit #
Name
Bit #
Name
PORT.SR
Port Status Register
(0,2,4,6)52h
15
--
7
--
14
--
6
--
13
--
5
--
12
--
4
--
11
--
3
--
10
--
2
TDM
9
--
1
8
--
0
RLOL
PMS
Bit 2: Transmit Driver Monitor Status (TDM)
This bits indicates the status of the transmit monitor circuit in the
transmit LIU.
0 = Transmit output not over loaded
1 = Transmit signal is overloaded
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PDF描述
DS318PIN Industrial Control IC
DS319 Two-Way Power Divider 10500 MHz
DS109333 Two-Way Power Divider 10500 MHz
DS322 32 Megabit (4 M x 8-Bit/2 M x 16-Bit) CMOS 1.8 Volt-only, Simultaneous Operation Flash Memory
DS323 32 Megabit (4 M x 8-Bit/2 M x 16-Bit) CMOS 1.8 Volt-only, Simultaneous Operation Flash Memory
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參數(shù)描述
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DS3177+ 制造商:Maxim Integrated Products 功能描述:IC TXRX DS3/E3 CSBGA
DS3177N+ 制造商:Maxim Integrated Products 功能描述:DS3/E3 SINGLE-CHIP TRANSCEIVER - Rail/Tube 制造商:Maxim Integrated Products 功能描述:IC TXRX DS3/E3 CSBGA
DS3177N+T 制造商:Maxim Integrated Products 功能描述:DS3/E3 SINGLE-CHIP TRANSCEIVER - Tape and Reel
DS-318 制造商:MA-COM 制造商全稱:M/A-COM Technology Solutions, Inc. 功能描述:Plug-In Two-Way Power Divider, 5 - 500 MHz
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