Logic ‘0’ = DGND = AGND = 0 V; Logic ‘1’ = VLS, C
參數(shù)資料
型號(hào)： CS5346-CQZR
廠商： Cirrus Logic Inc
文件頁數(shù)： 6/38頁
文件大小： 0K
描述： IC ADC AUD 103DB 200KHZ 48-LQFP
標(biāo)準(zhǔn)包裝： 2,000
位數(shù)： 24
采樣率（每秒）： 200k
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 2
功率耗散（最大）： 250mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 6 個(gè)單端，單極
配用： 598-1790-ND - BOARD EVAL FOR CS5346
14
DS861PP3
CS5346
SWITCHING CHARACTERISTICS - SERIAL AUDIO PORT
Logic ‘0’ = DGND = AGND = 0 V; Logic ‘1’ = VLS, CL = 20 pF. (Note 12)
Parameter
Symbol
Min
Typ
Max
Unit
Sample Rate
Single-Speed Mode
Double-Speed Mode
Quad-Speed Mode
Fs
8
50
100
-
50
100
200
kHz
MCLK Specifications
MCLK Frequency
fmclk
2.048
-
51.200
MHz
MCLK Input Pulse Width High/Low
tclkhl
8-
-
ns
Master Mode
LRCK Duty Cycle
-
50
-
%
SCLK Duty Cycle
-
50
-
%
SCLK falling to LRCK edge
tslr
-10
-
10
ns
SCLK falling to SDOUT valid
tsdo
0-
36
ns
Slave Mode
LRCK Duty Cycle
40
50
60
%
SCLK Period
Single-Speed Mode
Double-Speed Mode
Quad-Speed Mode
tsclkw
-
ns
SCLK Pulse Width High
tsclkh
30
-
ns
SCLK Pulse Width Low
tsclkl
48
-
ns
SCLK falling to LRCK edge
tslr
-10
-
10
ns
SCLK falling to SDOUT valid
tsdo
0-
36
ns
10
9
128
Fs
---------------------
10
9
64
Fs
------------------
10
9
64
Fs
------------------
相關(guān)PDF資料
PDF描述
CS5351-BZZ IC ADC AUD 108DB 204KHZ 24-TSSOP
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參數(shù)描述
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