參數(shù)資料
型號(hào)： CS5346-CQZR
廠商： Cirrus Logic Inc
文件頁數(shù)： 24/38頁
文件大小： 0K
描述： IC ADC AUD 103DB 200KHZ 48-LQFP
標(biāo)準(zhǔn)包裝： 2,000
位數(shù)： 24
采樣率（每秒）： 200k
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 2
功率耗散（最大）： 250mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 6 個(gè)單端，單極
配用： 598-1790-ND - BOARD EVAL FOR CS5346
30
DS861PP3
CS5346
7.4
MCLK Frequency - Address 05h
7.4.1
Master Clock Dividers (Bits 6:4)
Function:
Sets the frequency of the supplied MCLK signal. See Table 8 for the appropriate settings.
7.5
PGAOut Control - Address 06h
7.5.1
PGAOut Source Select (Bit 6)
Function:
This bit is used to configure the PGAOut pins to be either high impedance or PGA outputs. Refer to
7.6
Channel B PGA Control - Address 07h
7.6.1
Channel B PGA Gain (Bits 5:0)
Function:
76
543
21
0
Reserved
MCLK
Freq2
MCLK
Freq1
MCLK
Freq0
Reserved
MCLK Divider
MCLK Freq2 MCLK Freq1 MCLK Freq0
÷1
000
÷1.5
001
÷2
010
÷3
011
÷4
100
Reserved
101
Reserved
11
x
Table 8. MCLK Frequency
76
543
21
0
Reserved
PGAOut
Reserved
PGAOut
PGAOutA & PGAOutB
0
High Impedance
1
PGA Output
Table 9. PGAOut Source Selection
76
543
21
0
Reserved
Gain5
Gain4
Gain3
Gain2
Gain1
Gain0
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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