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參數(shù)資料
| 型號： | AS3543-ECTP |
| 廠商： | ams |
| 文件頁數(shù)： | 63/92頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CODEC AUDIO FRONT END 68CTBGA |
| 標準包裝： | 4,000 |
| 類型： | 音頻編解碼器 |
| 應(yīng)用： | 便攜式音頻，電話 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-TFBGA |
| 供應(yīng)商設(shè)備封裝： | 68-CTBGA（6x6） |
| 包裝： | 帶卷 (TR) |
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www.austriamicrosystems.com
Revision 1.11
65 - 91
AS3543 3v2
Data Sheet - R e g i s t e r D e f i n i t i o n
Table 58. CVDD1 Register
Name
Base
Default
CVDD1
2-wire serial
00h
Offset: 17h-1
CVDD1 DC/DC Buck Regulator Control Register
This is an extended register and needs to be enabled by writing 001b to Reg. 1Ch first.
This register is reset at a AVDD27-POR.
Bit
Bit Name
Default
Access
Bit Description
7
PROG_CVDD1
0
R/W
Selects the control mode for CVDD1
0: CVDD1 is in default mode controlled by pin VPRG1
1: CVDD1 is register controlled (Reg. 17-1h)
6:0
VSEL_CVDD1>6:0>
000000
R/W
The voltage select bits set the DC/DC output voltage level and
power the DC/DC converter down.
00h: DC/DC powered down
01h-40h: CVDD1=0.6V+VSEL_CVDD1*12.5mV
41h-70h: CVDD1=1.4V+(VSEL_CVDD1-40h)*25mV
71h-7Fh: CVDD1=2.6V+(VSEL_CVDD1-70h)*50mV
Table 59. CVDD2 Register
Name
Base
Default
CVDD2
2-wire serial
00h
Offset: 17h-2
CVDD2 DC/DC Buck Regulator Control Register
This is an extended register and needs to be enabled by writing 010b to Reg. 1Ch first.
This register is reset at a AVDD27-POR.
Bit
Bit Name
Default
Access
Bit Description
7
PROG_CVDD2
0
R/W
Selects the control mode for CVDD2
0: CVDD2 is in default mode controlled by pin VPRG2
1: CVDD2 is register controlled (Reg. 17-1h)
6:0
VSEL_CVDD2<6:0>
000000
R/W
The voltage select bits set the DC/DC output voltage level and
power the DC/DC converter down.
00h: DC/DC powered down
01h-40h: CVDD1=0.6V+VSEL_CVDD2*12.5mV
41h-70h: CVDD1=1.4V+(VSEL_CVDD2-40h)*25mV
71h-7Fh: CVDD1=2.6V+(VSEL_CVDD2-70h)*50mV
ams
AG
Technical
content
still
valid
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