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參數(shù)資料
| 型號： | AS3543-ECTP |
| 廠商： | ams |
| 文件頁數(shù)： | 26/92頁 |
| 文件大小： | 0K |
| 描述： | IC CODEC AUDIO FRONT END 68CTBGA |
| 標準包裝： | 4,000 |
| 類型： | 音頻編解碼器 |
| 應用： | 便攜式音頻，電話 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-TFBGA |
| 供應商設備封裝： | 68-CTBGA（6x6） |
| 包裝： | 帶卷 (TR) |
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www.austriamicrosystems.com
Revision 1.11
31 - 91
AS3543 3v2
Data Sheet - D e t a i l e d D e s c r i p t i o n - P o w e r M a n a g e m e n t F u n c t i o n s
9.1.4
LDO3 & LDO4
These LDOs can be used to generate the periphery voltage for the digital processor or other external components (e.g.
ext. DAC, USB-PHY, SD-Cards, NAND-Flashes, FM-Tuner …)
LDO3 has a separate input pin (BVDDP1) which can be connected to either the battery or a DCDC converter output.
Input Voltage BVDDP1 or BVDD
Output Voltage is PVDD1 & PVDD2 (1.2 to 3.5V)
Default value at start-up is defined by VPRG2 pin
Driver strength: 100mA, can be programmed to 200mA
9.1.5
Parameter
BVDD=3.6V, TA= 25
o
C, unless otherwise mentioned
Table 20. LDO Parameter
Symbol
Parameter
Condition
Min
Typ
Max
Unit
RON
On resistance
1
PSRR
Power supply rejection ratio
f=1kHz
70
dB
f=100kHz
40
IOFF
Shut down current
100
nA
IVDD
Supply current
without load
50
A
Noise
Output noise
10Hz < f < 100kHz
50
Vrms
tstart
Startup time
200
s
Vout_tol
Output voltage tolerance
minimum +/- 50mV
-2.5%
2.5%
mV
VLineReg
Line regulation
LDO2, Static
<1
mV
LDO2, Transient; Slope: tr=10s
<10
VLoadReg
Load regulation
LDO2, Static
<1
mV
LDO2, Transient; Slope: tr=10s
<10
ILIMIT
Current limitation
LDO1
100
LDO2, LDO3, LDO4
200
mA
LDO2, LDO3 and LDO4, has to be
enabled via register 18h-1, 18h-2, 18h-3
350
ams
AG
Technical
content
still
valid
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AS35490FLF | 制造商:TT Electronics / IRC 功能描述:AS35490FLF |
| AS35490HLF | 制造商:TT Electronics / IRC 功能描述:AS35490HLF |
| AS35490JLF | 制造商:TT Electronics / IRC 功能描述:AS35490JLF |
| AS35491FLF | 制造商:TT Electronics / IRC 功能描述:AS35491FLF |
| AS35491HLF | 制造商:TT Electronics / IRC 功能描述:AS35491HLF |
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