- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄366584 > ARM610 (Mitel Networks Corporation) General Purpose 32-Bit Microprocessor with 4kByte Cache,Write Buffer and Memory Management Unit(通用32位微處理器（帶4K字節(jié)緩存，寫緩沖器和存儲器管理單元）) PDF資料下載
參數(shù)資料
| 型號： | ARM610 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | General Purpose 32-Bit Microprocessor with 4kByte Cache,Write Buffer and Memory Management Unit(通用32位微處理器（帶4K字節(jié)緩存，寫緩沖器和存儲器管理單元）) |
| 中文描述： | 通用32位微處理器4KB的高速緩存，寫緩沖器和存儲器管理單元（通用32位微處理器（帶4K的字節(jié)緩存，寫緩沖器和存儲器管理單元）） |
| 文件頁數(shù)： | 131/174頁 |
| 文件大?。?/td> | 694K |
| 代理商： | ARM610 |
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Bus interface
ARM610 Data Sheet
10-7
Figure 10-7: Translation table-walking sequence (write) for section
10.8.5 Read - Lock - Write
The read-lock-write sequence is generated by a SWP instruction. On the bus it
consists of a read access followed by a write access to the same address, and both
are treated as nonsequential accesses. The cycle is differentiated by the
LOCK
has the timing of address, ie. it goes HIGH in the HIGH phase of
start of the read access. However, it always goes LOW at the end of the write access,
even if the following cycle is an idle cycle (unless of course the following access was
a read-lock-write sequence).
LOCK
MCLK
signal.
at the
Figure 10-8: Read - locked - write
MCLK
A[31:0]
nMREQ
nRW
WRITE
D[31:0]
READ
D[31:0]
Level 1 Address
Physical Address
Section Descriptor
Write Data
MCLK
A[31:0]
nMREQ
D[31:0]
address
LOCK
nRW
write
read
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PDF描述 |
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