Serial Ports Table 17 through Table 22 and Figure 14 describe Serial Port timing. Table 17. Serial Ports—External Clock " />
參數(shù)資料
型號： ADSP-BF535PKBZ-350
廠商： Analog Devices Inc
文件頁數(shù)： 24/44頁
文件大小： 0K
描述： IC DSP CONTROLLER 16BIT 260-BGA
產(chǎn)品培訓(xùn)模塊： Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
標(biāo)準(zhǔn)包裝： 1
系列： Blackfin®
類型： 定點(diǎn)
接口： PCI，SPI，SSP，UART，USB
時鐘速率： 350MHz
非易失內(nèi)存： 外部
芯片上RAM： 308kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.60V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 260-BBGA
供應(yīng)商設(shè)備封裝： 260-PBGA（19x19）
包裝： 托盤
ADSP-BF535
–30–
REV. A
Serial Ports
Table 17 through Table 22 and Figure 14 describe Serial Port
timing.
Table 17. Serial Ports—External Clock
Parameter
Min
Max
Unit
Timing Requirements
tSFSE
TFS/RFS Setup Before TCLK/RCLK
1
3.0
ns
tHFSE
TFS/RFS Hold After TCLK/RCLK
1
3.0
ns
tSDRE
Receive Data Setup Before RCLK
1
3.0
ns
tHDRE
Receive Data Hold Before RCLK
1
3.0
ns
tSCLKWE
TCLK/RCLK Width
(0.5
tSCLKE) – 1
ns
tSCLKE
TCLK/RCLK Period
2
tSCLK
ns
1 Referenced to sample edge.
Table 18. Serial Ports—Internal Clock
Parameter
Min
Max
Unit
Timing Requirements
tSFSI
TFS/RFS Setup Before TCLK/RCLK
1
7.0
ns
tHFSI
TFS/RFS Hold After TCLK/RCLK
1
2.0
ns
tSDRI
Receive Data Setup Before RCLK
1
7.0
ns
tHDRI
Receive Data Hold Before RCLK
1
4.0
ns
1 Referenced to sample edge.
Table 19. Serial Ports—External or Internal Clock
Parameter
Min
Max
Unit
Switching Characteristics
tDFSE
RFS Delay After RCLK (Internally Generated RFS)
1
10.0
ns
tHOFSE
RFS Hold After RCLK (Internally Generated RFS)
1
3.0
ns
1 Referenced to drive edge.
Table 20. Serial Ports—External Clock
Parameter
Min
Max
Unit
Switching Characteristics
tDFSE
TFS Delay After TCLK (Internally Generated TFS)
1
10.0
ns
tHOFSE
TFS Hold After TCLK (Internally Generated TFS)
1
3.0
ns
tDDTE
Transmit Data Delay After TCLK
1
10.0
ns
tHDTE
Transmit Data Hold After TCLK
1
3.0
ns
1 Referenced to drive edge.
Table 21. Serial Ports—Internal Clock
Parameter
Min
Max
Unit
Switching Characteristics
tDFSI
TFS Delay After TCLK (Internally Generated TFS)
1
6.0
ns
tHOFSI
TFS Hold After TCLK (Internally Generated TFS)
1
0.0
ns
tDDTI
Transmit Data Delay After TCLK
1
8.0
ns
tHDTI
Transmit Data Hold After TCLK
1
0.0
ns
tSCLKWI
TCLK/RCLK Width
0.5
tSCLK
ns
1 Referenced to drive edge.
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PDF描述
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