Clock and Reset Timing Table 11 and Figure 8 describe clock and reset operations. Per ABSOLUTE MAXIMUM RATINGS on Page 2" />
參數(shù)資料
型號(hào)： ADSP-BF535PKBZ-350
廠商： Analog Devices Inc
文件頁數(shù)： 17/44頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 260-BGA
產(chǎn)品培訓(xùn)模塊： Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
標(biāo)準(zhǔn)包裝： 1
系列： Blackfin®
類型： 定點(diǎn)
接口： PCI，SPI，SSP，UART，USB
時(shí)鐘速率： 350MHz
非易失內(nèi)存： 外部
芯片上RAM： 308kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.60V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 260-BBGA
供應(yīng)商設(shè)備封裝： 260-PBGA（19x19）
包裝： 托盤
ADSP-BF535
–24–
REV. A
Clock and Reset Timing
Table 11 and Figure 8 describe clock and reset operations. Per
tions of CLKIN and clock multipliers must not select core and
system clocks in excess of 350/300/200 MHz and 133 MHz,
respectively.
Table 11. Clock and Reset Timing
Parameter
Min
Max
Unit
Timing Requirements
tCKIN
CLKIN Period
25.0
100.0
ns
tCKINL
CLKIN Low Pulse
1
10.0
ns
tCKINH
CLKIN High Pulse
1
10.0
ns
tWRST
RESET Asserted Pulse Width Low2
11
tCKIN
ns
tMSD
Delay from
RESET Asserted to MSELx, SSELx, BYPASS,
and DF Valid
3
15.0
ns
tMSS
MSELx/SSELx/DF/BYPASS Stable Setup Before
RESET
Deasserted
4
2
tCKIN
ns
tMSH
MSELx/SSELx/DF/BYPASS Stable Hold After
RESET
Deasserted
2
tCKIN
ns
Switching Characteristics
tPFD
Flag Output Disable Time After
RESET Asserted
15.0
ns
1 Applies to Bypass mode and Non-bypass mode.
2 Applies after power-up sequence is complete. At power-up, the processor’s internal phase-locked loop requires no more than 2000 CLKIN cycles, while
RESET is asserted, assuming stable power supplies and CLKIN (not including start-up time of external clock oscillator).
3 SSELx, MSELx and DF values can change from this point, but the values must be valid.
4 SSELx, MSELx and DF values must be held from this time, until the hold time expires.
Figure 8. Clock and Reset Timing
SSEL1–0
MSEL6–0
BYPASS
DF
RESET
CLKIN
t WRS T
t CK IN H
tCK IN
tCK IN L
t MSH
t PF D
t MS D
t MS S
相關(guān)PDF資料
PDF描述
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ADSP-21364YSWZ-2AA IC DSP 32BIT 200MHZ EPAD 144LQFP
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參數(shù)描述
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ADSP-BF536BBC-4A 功能描述:IC DSP CTLR 16BIT 182CSPBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號(hào)處理器） 系列:Blackfin® 標(biāo)準(zhǔn)包裝:2 系列:StarCore 類型:SC140 內(nèi)核 接口:DSI，以太網(wǎng)，RS-232 時(shí)鐘速率:400MHz 非易失內(nèi)存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:431-FCPBGA（20x20） 包裝:托盤
ADSP-BF536BBCZ-3A 功能描述:IC DSP CTLR 16BIT 182CSPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號(hào)處理器） 系列:Blackfin® 標(biāo)準(zhǔn)包裝:40 系列:TMS320DM64x, DaVinci™ 類型:定點(diǎn) 接口:I²C，McASP，McBSP 時(shí)鐘速率:400MHz 非易失內(nèi)存:外部 芯片上RAM:160kB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:0°C ~ 90°C 安裝類型:表面貼裝 封裝/外殼:548-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:548-FCBGA（27x27） 包裝:托盤 配用:TMDSDMK642-0E-ND - DEVELPER KIT W/NTSC CAMERA296-23038-ND - DSP STARTER KIT FOR TMS320C6416296-23059-ND - FLASHBURN PORTING KIT296-23058-ND - EVAL MODULE FOR DM642TMDSDMK642-ND - DEVELOPER KIT W/NTSC CAMERA
ADSP-BF536BBCZ-3AX 制造商:Analog Devices 功能描述:182-MBGA PB-FREE - Trays
ADSP-BF536BBCZ-3B 功能描述:IC DSP CTLR 16BIT 208CSPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號(hào)處理器） 系列:Blackfin® 標(biāo)準(zhǔn)包裝:40 系列:TMS320DM64x, DaVinci™ 類型:定點(diǎn) 接口:I²C，McASP，McBSP 時(shí)鐘速率:400MHz 非易失內(nèi)存:外部 芯片上RAM:160kB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:0°C ~ 90°C 安裝類型:表面貼裝 封裝/外殼:548-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:548-FCBGA（27x27） 包裝:托盤 配用:TMDSDMK642-0E-ND - DEVELPER KIT W/NTSC CAMERA296-23038-ND - DSP STARTER KIT FOR TMS320C6416296-23059-ND - FLASHBURN PORTING KIT296-23058-ND - EVAL MODULE FOR DM642TMDSDMK642-ND - DEVELOPER KIT W/NTSC CAMERA
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