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參數(shù)資料
| 型號： | ADSP-2196MKSTZ-160 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 47/68頁 |
| 文件大小： | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 144-LQFP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | ADSP-21xx |
| 類型： | 定點(diǎn) |
| 接口： | 主機(jī)接口，SPI，SSP，UART |
| 時鐘速率： | 160MHz |
| 非易失內(nèi)存： | ROM（48 kB） |
| 芯片上RAM： | 40kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 2.50V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 144-LQFP |
| 供應(yīng)商設(shè)備封裝： | 144-LQFP（20x20） |
| 包裝： | 托盤 |
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out notice. Analog Devices assumes no obligation regarding future manufacturing unless otherwise agreed to in writing.
51
REV. PrA
For current information contact Analog Devices at 800/262-5643
ADSP-2196
September 2001
35(/,0,1$5< 7(&+1,&$/ '$7$
JTAG Test And Emulation Port Timing
Table 22. JTAG Port Timing
Parameter
Description
Min
Max
Unit
Switching Characteristics
t
DTDO
TDO Delay from TCK Low
4
ns
t
DSYS
System Outputs Delay After TCK Low1
05ns
Timing Parameters
t
TCK
TCK Period
20
ns
t
STAP
TDI, TMS Setup Before TCK High
4
ns
t
HTAP
TDI, TMS Hold After TCK High
4
ns
t
SSYS
System Inputs Setup Before TCK Low2
4ns
t
HSYS
System Inputs Hold After TCK Low2
5ns
t
TRSTW
TRST Pulsewidth3
4ns
1SystemOutputs = DATA15–0, ADDR21–0, MS3–0, RD, WR, ACK, CLKOUT, BG, PF7–0, TIMEXP, DT0, DT1, TCLK0, TCLK1, RCLK0, RCLK1,
TFS0, TFS1, RFS0, RFS1, BMS.
2System Inputs = DATA15–0, ADDR21–0, RD, WR, ACK, BR, BG, PF7–0, DR0, DR1, TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1,
CLKIN, RESET.
350 MHz max.
Figure 26. JTAG Port Timing
70 6
7' ,
7' 2
6<6 7 ( 0
,1 3 8 7 6
6<6 7 ( 0
28 7 3 8 7 6
7& .
W 7& .
W +7$ 3
W 67 $3
W '7'2
W66 <6
W +6<6
W '6 <6
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