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參數(shù)資料
| 型號： | ADSP-2196MKSTZ-160 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 18/68頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 144-LQFP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | ADSP-21xx |
| 類型： | 定點 |
| 接口： | 主機接口，SPI，SSP，UART |
| 時鐘速率： | 160MHz |
| 非易失內(nèi)存： | ROM（48 kB） |
| 芯片上RAM： | 40kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 2.50V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 144-LQFP |
| 供應(yīng)商設(shè)備封裝： | 144-LQFP（20x20） |
| 包裝： | 托盤 |
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35(/,0,1$5< 7(&+1,&$/ '$7$
This information applies to a product under development. Its characteristics and specifications are subject to change with-
out notice. Analog Devices assumes no obligation regarding future manufacturing unless otherwise agreed to in writing.
25
REV. PrA
For current information contact Analog Devices at 800/262-5643
ADSP-2196
September 2001
Clock In and Clock Out Cycle Timing
Table 8 and Figure 11 describe clock and reset operations. Per VDDINTInternal (Core) Supply Voltage, –0.3 to 3.0 V on
page 24, combinations of CLKIN and clock multipliers must not select core/peripheral clocks in excess of 160/100 MHz.
Table 8. Clock In and Clock Out Cycle Timing
Parameter
Description
Min
Max
Unit
Switching Characteristic
t
CKOD
CLKOUT delay from CLKIN
0
5.8
ns
t
CKO
CLKOUT period1
1Figure 11 shows a 2 ratio between CLKOUT = 2 CLKIN (or t
HCLK = 2
tCCLK), but the ratio has many programmable options. For more information
see the System Design chapter of the ADSP-219x/2191 DSP Hardware Reference.
10
ns
Timing Requirements
t
CK
CLKIN period2,3
2In clock multiplier mode and MSEL6–0 set for 1:1 (or CLKIN=CCLK), t
CK=tCCLK.
3In bypass mode, t
CK=tCCLK.
6.25
200
ns
t
CKL
CLKIN low pulse
2.2
ns
t
CKH
CLKIN high pulse
2.2
ns
t
WRST
RESET asserted pulsewidth low
200t
CLKOUT
ns
t
MSLS
MSELx/BYPASS stable before RESET asserted setup
160
s
t
MSLH
MSELx/BYPASS stable after RESET de-asserted hold
1000
ns
Figure 11. Clock In and Clock Out Cycle Timing
W &. 2 '
&/ . 2 8 7
06 ( / ±
%< 3$ 6 6
')
5( 6 ( 7
&/ . , 1
W :5 6 7
W &. +
W &.
W &. /
W 06+
W &. 2
W 3)'
W 06 '
W 06 6
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