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參數(shù)資料
| 型號(hào)： | AD9895KBCZRL |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 34/58頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC CCD SIGNAL PROC/GEN 64-CSPBGA |
| 標(biāo)準(zhǔn)包裝： | 2,000 |
| 類型： | CCD 信號(hào)處理器，12 位 |
| 輸入類型： | 邏輯 |
| 輸出類型： | 邏輯 |
| 接口： | 3 線串口 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-VFBGA，CSPBGA |
| 供應(yīng)商設(shè)備封裝： | 64-CSPBGA（9x9） |
| 包裝： | 帶卷 (TR) |
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REV. A
–4–
AD9891/AD9895
AD9891–ANALOG SPECIFICATIONS
Parameter
Min
Typ
Max
Unit
Notes
CDS
Gain
0
dB
Allowable CCD Reset Transient
500
mV
Input signal characteristics
*
Max Input Range before Saturation
1.0
V p-p
Max CCD Black Pixel Amplitude
±200
mV
PIXEL GAIN AMPLIFIER (PxGA)
Max Input Range
1.0
V p-p
Max Output Range
1.6
V p-p
Gain Control Resolution
64
Steps
Gain Monotonicity
Guaranteed
Gain Range
Min Gain (PxGA Code 32)
–2.5
dB
Med Gain (PxGA Code 0)
+3.5
dB
Default setting
Max Gain (PxGA Code 31)
+9.5
dB
VARIABLE GAIN AMPLIFIER (VGA)
Max Input Range
1.6
V p-p
Max Output Range
2.0
V p-p
Gain Control Resolution
1024
Steps
Gain Monotonicity
Guaranteed
Gain Range
Low Gain (VGA Code 70)
2
dB
Max Gain (VGA Code 1023)
36
dB
BLACK LEVEL CLAMP
Clamp Level Resolution
256
Steps
Clamp Level
Measured at ADC output
Min Clamp Level
0
LSB
Max Clamp Level
63.75
LSB
A/D CONVERTER
Resolution
10
Bits
Differential Nonlinearity (DNL)
±0.4
±1.0
LSB
No Missing Codes
Guaranteed
Full-Scale Input Voltage
2.0
V
VOLTAGE REFERENCE
Reference Top Voltage (VRT)
2.0
V
Reference Bottom Voltage (VRB)
1.0
V
SYSTEM PERFORMANCE
Includes entire signal chain
Gain Accuracy
Includes 4 dB default PxGA gain
Low Gain (VGA Code 70)
5
6
7
dB
Gain = (0.035
Code) + 3.55 dB
Max Gain (VGA Code 1023)
38.5
39.5
40.5
dB
Peak Nonlinearity, 500 mV Input Signal
0.2
%
12 dB gain applied
Total Output Noise
0.6
LSB rms
AC grounded input, 6 dB gain applied
Power Supply Rejection (PSR)
40
dB
Measured with step change on supply
*Input signal characteristics defined as follows:
1V MAX
INPUT
SIGNAL RANGE
200mV MAX
OPTICAL
BLACK PIXEL
500mV TYP
RESET
TRANSIENT
Specifications subject to change without notice.
(AVDD1, AVDD2 = 3.0 V, fCLI = 20 MHz, TMIN to TMAX, unless otherwise noted.)
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