參數(shù)資料
型號(hào)： AD9653-125EBZ
廠(chǎng)商： Analog Devices Inc
文件頁(yè)數(shù)： 40/40頁(yè)
文件大?。?/td> 0K
描述： BOARD EVAL FOR AD9653
標(biāo)準(zhǔn)包裝： 1
ADC 的數(shù)量： 4
位數(shù)： 16
采樣率（每秒）： 125M
數(shù)據(jù)接口： LVDS，串行，SPI?
輸入范圍： 2 Vpp
在以下條件下的電源（標(biāo)準(zhǔn)）： 673mW @ 125MSPS
工作溫度： -40°C ~ 85°C
已用 IC / 零件： AD9653
已供物品： 板
Data Sheet
AD9653
Rev. 0 | Page 9 of 40
TIMING SPECIFICATIONS
Table 7.
Parameter
Description
Limit
Unit
SYNC TIMING REQUIREMENTS
t
SSYNC
SYNC to rising edge of CLK+ setup time
0.24
ns typ
t
HSYNC
SYNC to rising edge of CLK+ hold time
0.40
ns typ
SPI TIMING REQUIREMENTS
t
DS
Setup time between the data and the rising edge of SCLK
2
ns min
t
DH
Hold time between the data and the rising edge of SCLK
2
ns min
t
CLK
Period of the SCLK
40
ns min
t
S
Setup time between CSB and SCLK
2
ns min
t
H
Hold time between CSB and SCLK
2
ns min
t
HIGH
SCLK pulse width high
10
ns min
t
LOW
SCLK pulse width low
10
ns min
t
EN_SDIO
Time required for the SDIO pin to switch from an input to an output relative to the
SCLK falling edge (not shown in Figure 75)
10
ns min
t
DIS_SDIO
Time required for the SDIO pin to switch from an output to an input relative to the
SCLK rising edge (not shown in Figure 75)
10
ns min
Timing Diagrams
Refer to the Memory Map Register Descriptions section and Table 23 for SPI register settings.
Figure 2. 16-Bit DDR/SDR, Two-Lane, 1× Frame Mode (Default)
D0–A
D0+A
D1–A
D1+A
FCO–
BYTEWISE
MODE
FCO+
D0–A
D0+A
D1–A
D1+A
FCO–
DCO
DCO+
CLK+
VIN±x
CLK–
DCO–
FCO+
BITWISE
MODE
SDR
DDR
10538-
002
MSB
N – 17
D14
N – 17
D13
N – 17
D12
N – 17
D11
N – 17
D10
N – 17
D09
N – 17
D08
N – 17
MSB
N – 16
D14
N – 16
D13
N – 16
D12
N – 16
D11
N – 16
D10
N – 16
D09
N – 16
D08
N – 16
D07
N – 17
D06
N – 17
D05
N – 17
D04
N – 17
D03
N – 17
D02
N – 17
D01
N – 17
LSB
N – 17
D07
N – 16
D06
N – 16
D05
N – 16
D04
N – 16
D03
N – 16
D02
N – 16
D01
N – 16
LSB
N – 16
MSB
N – 17
D13
N – 17
D11
N – 17
D09
N – 17
D07
N – 17
D05
N – 17
D03
N – 17
D01
N – 17
MSB
N – 16
D13
N – 16
D11
N – 16
D09
N – 16
D07
N – 16
D05
N – 16
D03
N – 16
D01
N – 16
D14
N – 17
D12
N – 17
D10
N – 17
D08
N – 17
D06
N – 17
D04
N – 17
D02
N – 17
LSB
N – 17
D14
N – 16
D12
N – 16
D10
N – 16
D08
N – 16
D06
N – 16
D04
N – 16
D02
N – 16
LSB
N – 16
tA
tDATA
tLD
tEH
tFCO
tFRAME
tPD
tCPD
tEL
N – 1
N
N + 1
相關(guān)PDF資料
PDF描述
CDB5532U BOARD EVAL FOR CS5532U ADC
CDB5530U BOARD EVAL FOR CS5530
SIP4613ADVP-T1-E3 IC LOAD SW HISIDE 1A SC75-6
CDB5534U EVAL BOARD FOR CS5534
AD9648-125EBZ EVAL BOARD AD9648-125
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
AD9653BCPZ-125 制造商:Analog Devices 功能描述:16 BIT 125MSPS 1.8V QUAD ADC - Trays 制造商:Analog Devices 功能描述:IC ADC 16BIT SRL 125MSPS 48LFCSP 制造商:Analog Devices 功能描述:ADC QUAD 16BIT 125MSPS 48LFCSP 制造商:Analog Devices 功能描述:ADC, QUAD, 16BIT, 125MSPS, 48LFCSP 制造商:Analog Devices 功能描述:16 Bit 125Msps 1.8V Quad ADC 制造商:Analog Devices 功能描述:IC, ADC, 16BIT, 125MSPS, SPI, LFCSP-48, Resolution (Bits):16bit, Sampling Rate:125MSPS, Supply Voltage Type:Single, Supply Voltage Min:1.7V, Supply Voltage Max:1.9V, Supply Current:305mA, Digital IC Case Style:LFCSP, No. of Pins:48 , RoHS Compliant: Yes 制造商:Analog Devices 功能描述:CONVERTER - ADC
AD9653BCPZRL7-125 功能描述:IC ADC 16BIT 125MSPS SRL 48LFCSP RoHS:是 類(lèi)別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉(zhuǎn)換器 系列:- 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:250 系列:- 位數(shù):12 采樣率（每秒）:1.8M 數(shù)據(jù)接口:并聯(lián) 轉(zhuǎn)換器數(shù)目:1 功率耗散（最大）:1.82W 電壓電源:模擬和數(shù)字 工作溫度:-40°C ~ 85°C 安裝類(lèi)型:表面貼裝 封裝/外殼:48-LQFP 供應(yīng)商設(shè)備封裝:48-LQFP（7x7） 包裝:管件 輸入數(shù)目和類(lèi)型:2 個(gè)單端，單極
AD9655-125EBZ 功能描述:AD9655 - 16 Bit 125M Samples per Second Analog to Digital Converter (ADC) Evaluation Board 制造商:analog devices inc. 系列:- 零件狀態(tài):有效 A/D 轉(zhuǎn)換器數(shù):2 位數(shù):16 采樣率（每秒）:125M 數(shù)據(jù)接口:LVDS - 串行，SPI 輸入范圍:2.8 Vpp 不同條件下的功率（典型值）:313mW @ 125MSPS 使用的 IC/零件:AD9655 所含物品:板 標(biāo)準(zhǔn)包裝:1
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AD9656EBZ 制造商:Analog Devices 功能描述:16BIT 125MSPS 1.8V QUAD ADC W/SERIAL OUT - Boxed Product (Development Kits)
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