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參數(shù)資料
| 型號(hào)： | XRT86L30 |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 224/284頁 |
| 文件大?。?/td> | 4058K |
| 代理商： | XRT86L30 |
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XRT86L30
SINGLE T1/E1/J1 FRAMER/LIU COMBO
REV. P1.0.1
PRELIMINARY
219
11.2.3 Multiplexed High-Speed Mode
When the Back-plane interface data rate is 12.352Mbit/s, 16.384Mbit/s, HMVIP 16.384Mbit/s, and H.100
16.384Mbit/s, the interface signals are all configured as inputs, except the receive serial data on RxSER and
the multi frame sync pulse provided by the framer. The Back-plane Interface is processing data through
TxSER0 or TxSER4 pins at 12.352Mbit/s or 16.384Mbit/s. The local Terminal Equipment multiplexes payload
and signaling data of every four channels into one serial data stream. Payload and signaling data of Channel 0-3
are multiplexed onto the Transmit Serial Data pin of Channel 0. Payload and signaling data of Channel 4-7 are
multiplexed onto the Transmit Serial Data pin of Channel 4. Free-running clocks of 12.352MHz are supplied to
the Transmit Input Clock pin of Channel 0 and Channel 4 of the framer. The local Terminal Equipment provides
multiplexed payload data at rising edge of this Transmit Input Clock. The Transmit High-speed Back-plane Inter-
face of the framer then latches incoming serial data at falling edge of the clock. The local Terminal Equipment
maps four 1.544Mbit/s DS1 data streams into one 12.352Mbit/s serial data stream as described below:
1.
The F-bit of four channels are repeated and grouped together to form the first octet of the multiplexed data
stream. The F-bit of Channel 0 is sent first, followed by F-bit of Channel 1 and 2. The F-bit of Channel 3 is
sent last. The table below shows bit-pattern of the first octet.
F
X
: F-bit of Channel X
2.
Payload data of four channels are repeated and grouped together in a bit-interleaved way. The first pay-
load bit of Timeslot 0 of Channel 0 is sent first, followed by the first payload bit of Timeslot 0 of Channel 1
and 2. The first payload bit of Timeslot 0 of Channel 3 is sent last. After the first bits of Timeslot 0 of all four
channels are sent, it comes the second bit of Timeslot 0 of Channel 0 and so on. The table below demon-
strates how payload bits of four channels are mapped into the 12.352Mbit/s data stream.
X
Y
: The Xth payload bit of Channel Y
3.
The local Terminal Equipment also multiplexes signaling bits with payload bits and sends them together
through the 12.352Mbit/s data stream. When the Terminal Equipment is sending the fifth payload bit of
each channel, instead of sending it twice, it inserts the signaling bit A of that corresponding channel. Simi-
larly, the sixth payload bit of a each channel is followed by the signaling bit B of that channel; the seventh
payload bit is followed by the signaling bit C; the eighth payload bit is followed by the signaling bit D.
FIRST OCTET OF 12.352MBIT/S DATA STREAM
B
IT
0
B
IT
1
B
IT
2
B
IT
3
B
IT
4
B
IT
5
B
IT
6
B
IT
7
F
0
F
0
F
1
F
1
F
2
F
2
F
3
F
3
SECOND OCTET OF 12.352MBIT/S DATA STREAM
B
IT
0
B
IT
1
B
IT
2
B
IT
3
B
IT
4
B
IT
5
B
IT
6
B
IT
7
1
0
1
0
1
1
1
1
1
2
1
2
1
3
1
3
THIRD OCTET OF 12.352MBIT/S DATA STREAM
B
IT
0
B
IT
1
B
IT
2
B
IT
3
B
IT
4
B
IT
5
B
IT
6
B
IT
7
2
0
2
0
2
1
2
1
2
2
2
2
2
3
2
3
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT86L30IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH221 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH221IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH328 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT86L30_08 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SINGLE T1/E1/J1 FRAMER/LIU COMBO |
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| XRT86L30IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:SINGLE T1/E1/J1 FRAMER/LIU COMBO |
| XRT86L30IV | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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