REV. 1.0.0 12 RNEG/LCV7 RNEG/LCV6 RNEG/LCV5 RNEG/LCV4 RNEG/LCV3 RNEG/LCV2 RNEG/LCV1 RN" />
參數(shù)資料
型號(hào)： XRT83SL28IV-F
廠商： Exar Corporation
文件頁(yè)數(shù)： 6/47頁(yè)
文件大?。?/td> 0K
描述： IC LIU SH E1 8CH 144TQFP
標(biāo)準(zhǔn)包裝： 60
類型： 線路接口裝置（LIU）
驅(qū)動(dòng)器/接收器數(shù)： 8/8
規(guī)程： T1，E1，J1
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-TQFP（20x20）
包裝： 托盤
XRT83SL28
xr
8-CHANNEL E1 SHORT-HAUL LINE INTERFACE UNIT
REV. 1.0.0
12
RNEG/LCV7
RNEG/LCV6
RNEG/LCV5
RNEG/LCV4
RNEG/LCV3
RNEG/LCV2
RNEG/LCV1
RNEG/LCV0
60
64
117
121
49
45
136
132
O
Same as Host Mode.
RTIP7
RTIP6
RTIP5
RTIP4
RTIP3
RTIP2
RTIP1
RTIP0
75
87
94
106
34
22
15
3
I
Same as Host Mode.
RRING7
RRING6
RRING5
RRING4
RRING3
RRING2
RRING1
RRING0
76
86
95
105
33
23
14
4
I
Same as Host Mode.
TXOE
9
I
Transmit Output Enable (Global Pin for All 8 Channels)
Upon power up, the transmitters are tri-stated. Enabling the transmitters is
controlled by pulling the TXOE hardware pin "High". If the TxOE pin is pulled
"Low", all 8 transmitters are tri-stated.
NOTE: TxOE is ideal for redundancy applications. See the Redundancy
Applications Section of this datasheet for more details. Internally
pulled "Low" with a 50K
resistor.
DMO7
DMO6
DMO5
DMO4
DMO3
DMO2
DMO1
DMO0
73
72
109
108
36
37
144
1
O
Same as Host Mode.
TCLK7
TCLK6
TCLK5
TCLK4
TCLK3
TCLK2
TCLK1
TCLK0
69
66
115
112
40
43
138
141
I
Transmit Clock Input
TCLK is the input facility clock used to sample the incoming TPOS/TNEG data.
If TCLK is pulled "Low" for 16 MCLK cycles, the transmitter outputs at TTIP/
TRING are tri-stated. If TCLK is pulled "High" for 16 MCLK cycles, the trans-
mitter outputs at TTIP/TRING will send an All Ones pattern. TPOS/TNEG data
can be sampled on either edge of TCLK selected by the TCLKinv pin.
NOTE: The TCLKinv pin is a global setting that applies to all 8 channels.
NAME
PIN
TYPE
DESCRIPTION
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PDF描述
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