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參數(shù)資料
| 型號： | XC2S30-6VQ100C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 19/99頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 2.5V C-TEMP 100-PQFP |
| 標準包裝： | 90 |
| 系列： | Spartan®-II |
| LAB/CLB數(shù)： | 216 |
| 邏輯元件/單元數(shù)： | 972 |
| RAM 位總計： | 24576 |
| 輸入/輸出數(shù)： | 60 |
| 門數(shù)： | 30000 |
| 電源電壓： | 2.375 V ~ 2.625 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 100-TQFP |
| 供應商設備封裝： | 100-VQFP（14x14） |
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Spartan-II FPGA Family: Functional Description
DS001-2 (v2.8) June 13, 2008
Module 2 of 4
Product Specification
26
R
Figure 20: Slave Parallel Write Timing
Figure 21: Slave Parallel Write Abort Waveforms
DS001_20_061200
CCLK
No Write
Write
No Write
Write
DATA[7:0]
CS
WRITE
TSMDCC
TSMCCD
TSMCKBY
TSMCCCS
TSMWCC
TSMCCW
TSMCSCC
BUSY
Symbol
Description
Units
TSMDCC
CCLK
D0-D7 setup/hold
5
ns, min
TSMCCD
D0-D7 hold
0
ns, min
TSMCSCC
CS setup
7
ns, min
TSMCCCS
CS hold
0
ns, min
TSMCCW
WRITE setup
7
ns, min
TSMWCC
WRITE hold
0
ns, min
TSMCKBY
BUSY propagation delay
12
ns, max
FCC
Maximum frequency
66
MHz, max
FCCNH
Maximum frequency with no handshake
50
MHz, max
DS001_21_032300
CCLK
CS
WRITE
Abort
DATA[7:0]
BUSY
相關PDF資料 |
PDF描述 |
|---|---|
| EP4S100G5F45I3N | IC STRATIX IV FPGA 530K 1932FBGA |
| 24LCS52-I/MS | IC EEPROM 2KBIT 400KHZ 8MSOP |
| ABC60DREH-S13 | CONN EDGECARD 120PS .100 EYELET |
| ACC60DREH-S13 | CONN EDGECARD 120POS .100 EYELET |
| XC2S30-5VQ100I | IC FPGA 2.5V I-TEMP 100-VQFP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XC2S30-6VQ100I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-II 2.5V FPGA Family:Introduction and Ordering Information |
| XC2S30-6VQG100C | 制造商:Xilinx 功能描述:FPGA SPARTAN-II 30K GATES 972 CELLS 263MHZ 2.5V 100VTQFP - Trays |
| XC2S30-6VQG100I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-II FPGA Family |
| XC2S400E | 制造商:XILINX 制造商全稱:XILINX 功能描述:Platform Flash In-System Programmable Configuration PROMS |
| XC2S400E-6FG456C | 制造商:Xilinx 功能描述:FPGA SPARTAN-IIE 400K GATES 10800 CELLS 357MHZ 1.8V 456FBGA - Trays |
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