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參數(shù)資料
| 型號(hào)： | XA3SD3400A-4FGG676I |
| 廠商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 11/58頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | SPARTAN-3ADSP FPGA 3400K 676FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Extended Spartan 3A FPGA Family |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | Spartan®-3A DSP XA |
| LAB/CLB數(shù)： | 5968 |
| 邏輯元件/單元數(shù)： | 53712 |
| RAM 位總計(jì)： | 2322432 |
| 輸入/輸出數(shù)： | 469 |
| 門(mén)數(shù)： | 3400000 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 676-BGA |
| 供應(yīng)商設(shè)備封裝： | 676-FBGA（27x27） |
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XA Spartan-3A DSP Automotive FPGA Family Data Sheet
DS705 (v2.0) April 18, 2011
Product Specification
19
Input Setup and Hold Times
Table 20: Setup and Hold Times for the IOB Input Path
Symbol
Description
Conditions
IFD_DELAY
_VALUE
Device
Speed Grade: -4
Units
Min
Setup Times
TIOPICK
Time from the setup of data at the Input pin to
the active transition at the ICLK input of the
Input Flip-Flop (IFF). No Input Delay is
programmed.
LVCMOS25(2)
0
XA3SD1800A
1.81
ns
XA3SD3400A
1.88
ns
TIOPICKD
Time from the setup of data at the Input pin to
the active transition at the ICLK input of the
Input Flip-Flop (IFF). The Input Delay is
programmed.
LVCMOS25(2)
1
XA3SD1800A
2.24
ns
22.83
ns
33.64
ns
44.20
ns
54.16
ns
65.09
ns
76.02
ns
86.63
ns
1
XA3SD3400A
2.44
ns
23.02
ns
33.81
ns
44.39
ns
54.26
ns
65.08
ns
75.95
ns
86.55
ns
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