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參數(shù)資料
| 型號(hào)： | UPD750066CU(A)-XXX |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, MROM, MICROCONTROLLER, PDIP42 |
| 封裝： | 0.600 INCH, 1.778 MM PITCH, SHRINK, PLASTIC, DIP-42 |
| 文件頁(yè)數(shù)： | 46/83頁(yè) |
| 文件大小： | 730K |
| 代理商： | UPD750066CU(A)-XXX |
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PD750064, 750066, 750068, 750064(A), 750066(A), 750068(A)
50
Data Sheet U10165EJ2V1DS
Instruction
Number
Addressing
Mnemonic
Operand
of Machine
Operation
Skip Condition
Group
of Bytes
Cycles
Area
Branch
BR
PCDE
2
3
PD750064
PC11–0
← PC11-8+DE
PD750066, 750068
PC12–0
← PC12-8+DE
PCXA
2
3
PD750064
PC11–0
← PC11-8+XA
PD750066, 750068
PC12–0
← PC12-8+XA
BCDE
2
3
PD750064
*6
PC11–0
← BCDENote 1
PD750066, 750068
PC12–0
← BCDENote 2
BCXA
2
3
PD750064
*6
PC11–0
← BCXANote 1
PD750066, 750068
PC12–0
← BCXANote 2
BRANote 3
33
PD750064
*11
PC11–0
← addr1
PD750066, 750068
PC12–0
← addr1
BRCB
!caddr
2
PD750064
*8
PC11–0
← caddr11–0
PD750066, 750068
PC12–0
← PC12+caddr11–0
Subroutine
CALLANote 3
!addr1
3
PD750064
*11
stack control
(SP–2)
← ×, ×, MBE, RBE
(SP–6) (SP–3) (SP–4)
← PC11–0
(SP–5)
← 0, 0, 0, 0
PC11–0
← addr1, SP ← SP–6
PD750066, 750068
(SP–2)
← ×, ×, MBE, RBE
(SP–6) (SP–3) (SP–4)
← PC11–0
(SP–5)
← 0, 0, 0, PC12
PC12–0
← addr1, SP ← SP–6
Notes 1.
“0” must be set to B register.
2.
Only low-order one bit is valid in B register.
3.
The operations indicated with thick lines can be performed only in the Mk II mode. The other operations
can be performed only in the Mk I mode.
相關(guān)PDF資料 |
PDF描述 |
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