參數(shù)資料
型號： SYM53C895A
廠商： LSI Corporation
英文描述： PCI to Ultra2 SCSI Controller(PCI與Ultra2 SCSI連接控制器)
中文描述： PCI到Ultra2 SCSI控制器（的PCI與Ultra2的SCSI連接控制器）
文件頁數(shù)： 344/352頁
文件大小： 4647K
代理商： SYM53C895A
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IX-10
Index
STOP command
2-9
stop signal
3-7
STOP/ signal
3-7
store
2-22
stress ratings
6-2
subsystem ID
2-57
subsystem ID (SID)
4-11
subsystem ID access (SIDA)
4-18
subsystem vendor ID
2-57
subsystem vendor ID (SVID)
4-10
SVID
2-57
SWIDE register
2-50
,
2-51
SXFER
2-40
SYM53C700 compatibility (COM)
4-71
SYM53C895A
new features
1-3
SYNC_IRQD (SI)
4-52
synchronous
data transfer rates
2-39
operation
2-39
SCSI receive
2-30
SCSI send
2-29
synchronous clock conversion factor (SCF[2:0])
4-30
system signals
3-4
T
table indirect
5-18
mode
5-17
table relative
5-19
target
mode
5-8
,
5-13
SATN/ active (M/A)
4-75
mode (TRG)
4-23
ready
3-6
timing
6-14
TCK
3-16
TDI
3-16
TDO
3-16
TEMP register
5-34
temporary (TEMP)
4-58
termination
2-37
test interface signals
3-16
TEST_HSC
3-16
TEST_RST/
3-16
third dword
5-34
timer test mode (TTM)
4-91
TMS
3-16
TolerANT
1-5
,
6-6
enable (TE)
4-90
technology
1-5
benefits
1-5
electrical characteristics
6-6
totem pole output
3-3
transfer
control
2-22
control instructions
5-25
and SCRIPTS instruction prefetching
2-22
count
5-33
counter
5-12
information
2-17
rate
synchronous
2-39
TRDY/
2-9
,
3-6
TRST/
3-16
U
Ultra SCSI
clock conversion factor bits
4-31
enable (USE)
4-29
high voltage differential transfers 20.0 mbytes (8-bit trans-
fers) or 40.0 mbytes (16-bit transfers) 80 MHz clock
6-59
single-ended transfers 20.0 mbytes (8-bit transfers) or 40.0
mbytes (16-bit transfers) quadrupled 40 MHz clock
6-58
Ultra2 SCSI
1-4
benefits
1-4
designing an Ultra2 SCSI system
2-20
LVD Link
2-33
synchronous data transfers
2-40
transfers 40.0 mbytes (8-bit transfers) or 80.0 mbytes (16-bit
transfers) quadrupled 40 MHz clock
6-59
unexpected disconnect (UDC)
4-73
,
4-77
updated address (UA)
4-104
upper register address line (A7)
5-22
use data8/SFBR
5-22
V
VDD
3-17
-A
3-17
-core
3-17
vendor
ID (VID)
4-3
unique enhancement, bit 1 (VUE1)
4-28
unique enhancements, bit 0 (VUE0)
4-28
version (VER[2:0])
4-16
VSS
3-17
-A
3-17
-core
3-17
W
wait
disconnect instruction
5-16
for a disconnect
2-17
for valid phase
5-31
reselect instruction
5-16
select instruction
5-14
wide SCSI
chained block moves
2-50
receive (WSR)
4-29
receive bit
2-50
send (WSS)
4-28
send bit
2-50
won arbitration (WOA)
4-44
write
read instructions
5-21
read system memory from SCRIPTS
5-33
write and invalidate
enable (WIE)
4-4
enable (WRIE)
4-58
WSR bit
2-50
WSS flag
2-50
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PDF描述
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