參數(shù)資料
型號(hào)： ST10F273M-4Q3
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 64 MHz, MICROCONTROLLER, PQFP144
封裝： 28 X 28 MM, 3.40 MM HEIGHT, 0.65 MM PITCH, PLASTIC, QFP-144
文件頁(yè)數(shù)： 80/182頁(yè)
文件大小： 3222K
代理商： ST10F273M-4Q3
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Electrical characteristics
ST10F273M
170/182
24.8.18
CLKOUT and READY
VDD = 5V ± 10%, VSS = 0V, TA = -40 to + 125°C, CL = 50pF
Table 73.
CLKOUT and READY timings
Symbol
Parameter
fCPU = 40 MHz
TCL = 12.5ns
Variable CPU clock
1/2 TCL = 1 to 40 MHz
Unit
Min
Max
Min
Max
t29
CC CLKOUT cycle time
25
2TCL
ns
t30
CC CLKOUT high time
9
–
TCL – 3.5
–
t31
CC CLKOUT low time
10
–
TCL – 2.5
–
t32
CC CLKOUT rise time
–
4
–
4
t33
CC CLKOUT fall time
–
4
–
4
t34
CC
CLKOUT rising edge to
ALE falling edge
– 2 + tA
8 + tA
– 2 + tA
8 + tA
t35
SR
Synchronous READY
setup time to CLKOUT
17
–
17
–
t36
SR
Synchronous READY
hold time after CLKOUT
2–
2
–
t37
SR
Asynchronous READY
low time
35
–
2TCL + 10
–
t58
SR
Asynchronous READY
setup time(1)
1.
These timings are given for characterization purposes only, in order to assure recognition at a specific
clock edge.
17
–
17
–
t59
SR
Asynchronous READY
hold time (1)
2–
2
–
t60
SR
Async. READY hold time
after RD, WR high
(Demultiplexed bus)(2)
2.
Demultiplexed bus is the worst case. For multiplexed bus 2TCL are to be added to the maximum values.
This adds even more time for deactivating READY. 2tA and tC refer to the next following bus cycle, tF refers
to the current bus cycle.
02tA + tC + tF
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