參數(shù)資料
型號(hào)： ST10F273M-4Q3
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 64 MHz, MICROCONTROLLER, PQFP144
封裝： 28 X 28 MM, 3.40 MM HEIGHT, 0.65 MM PITCH, PLASTIC, QFP-144
文件頁(yè)數(shù)： 108/182頁(yè)
文件大?。?/td> 3222K
代理商： ST10F273M-4Q3
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ST10F273M
Internal Flash memory
IFlash is not fetchable when a programming operation is active: The write operation
commands must be executed from another memory (one of the on-chip RAMs or some
external memory).
Warning:
During a Write operation, when bit LOCK of FCR0 is set, it is
forbidden to write into the Flash Control Registers.
Power supply drop
If during a write operation the internal low voltage supply drops below a certain internal
voltage threshold, any write operation running is suddenly interrupted and the module is
reset to Read mode. At following Power-on, the interrupted Flash write operation must be
repeated.
5.4
Flash control registers description
5.4.1
Flash control register 0 low (FCR0L)
The Flash Control Register 0 Low (FCR0L), together with the Flash Control Register 0 High
(FCR0H), is used to enable and to monitor all the write operations on the IFlash. The user
has no access in write mode to the Test-Flash (B0TF). Moreover, the Test-Flash block is
seen by the user in Bootstrap mode only.
FCR0L (0x0E 0000)
FCR
Reset value: 0000h
15
14
13
12
11
10
987
65432
10
Reserved
DBSY
1
BSY
0
LOCK
Reserved
BSY
NVR
Res
-
RORORO
-
RO
-
Table 7.
FCR0L register description
Bit
Name
Function
15:7
-
Reserved. These bits must be left to their reset value (0).
6
DBSY1
Dummy Bank1 Busy
It is a replication of the BSY0 bit: it is set whenever a write operation is on-going.
This bit is emulating the BSY1 bit of the ST10F273E device. When write
operations are on going on B0F10 and/or B0F11 blocks of the ST10F273M, this
bit will be set in order to indicate that their equivalent B1F0 or B1F1 in the
ST10F273E are busy.
5
BSY0
Bank0 Busy
This bits indicate that a write operation is running in the Bank0. It is automatically
set when bit WMS is set. When this bit is set every read access to the Bank0 will
output invalid data (software trap 009Bh), while every write access will be ignored.
At the end of the write operation or during a Program or Erase Suspend this bit is
automatically reset and Flash Bank returns to read mode. After a Program or
Erase Resume this bit is automatically set again.
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PDF描述
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參數(shù)描述
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