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參數(shù)資料
| 型號： | SI5327D-C-GMR |
| 廠商： | SILICON LABORATORIES |
| 元件分類： | 時鐘產(chǎn)生/分配 |
| 英文描述： | 243 MHz, PROC SPECIFIC CLOCK GENERATOR, QCC36 |
| 封裝： | 6 X 6 MM, ROHS COMPLIANT, MO-220VJJD, QFN-36 |
| 文件頁數(shù)： | 42/60頁 |
| 文件大?。?/td> | 715K |
| 代理商： | SI5327D-C-GMR |
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Si5327
Preliminary Rev. 0.4
47
Reset value = 0000 0000
Reset value = 0000 1111
Register 137.
Bit
D7D6D5D4D3D2D1D0
Name
FASTLOCK
Type
RR
RRR
RR
R/W
Bit
Name
Function
7:1
Reserved
Do not modify.
0
FASTLOCK
This bit must be set to 1 to enable FASTLOCK. This improves initial lock time by
dynamically changing the loop bandwidth.
Register 138.
Bit
D7D6D5D4D3D2D1D0
Name
LOS2_EN
LOS1_EN
Type
RR
RRR
R
R/W
Bit
Name
Function
7:2
Reserved
1LOS2_EN
Enable CKIN2 LOS Monitoring on the Specified Input (2 of 2).
Note:
LOS2_EN is split between two registers.
00: Disable LOS monitoring
01: Reserved
10: Enable LOSA monitoring
11: Enable LOS monitoring
LOSA is a slower and less sensitive version of LOS. SEe the Si53xx Family Reference
Manual for details.
0LOS1_EN
Enable CKIN1 LOS Monitoring on the Specified Input (1 of 2).
Note:
LOS1_EN is split between two registers.
00: Disable LOS monitoring
01: Reserved
10: Enable LOSA monitoring
11: Enable LOS monitoring
LOSA is a slower and less sensitive version of LOS. See the Si53xx Family Reference
Manual for details.
相關(guān)PDF資料 |
PDF描述 |
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| SI5334C-A00153-GM | PLL BASED CLOCK DRIVER, QCC24 |
| SI5334C-A00160-GM | PLL BASED CLOCK DRIVER, QCC24 |
| SI5334A-A00102-GM | PLL BASED CLOCK DRIVER, QCC24 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| SI5328 | 制造商:SILABS 制造商全稱:SILABS 功能描述:ITU-T G.8262 SYNCHRONOUS ETHERNET JITTER-ATTENUATING CLOCK MULTIPLIER |
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| SI5328C-C-GM | 制造商:Silicon Laboratories Inc 功能描述:G.8262 SYNCE CLOCK MULTIPLIER/JITTER ATTENUATOR - Trays 制造商:Silicon Laboratories Inc 功能描述:IC TIMING CLOCK 36QFN 制造商:Silicon Laboratories Inc 功能描述:Clock Generators & Support Products G.8262 SyncE Clock Multiplier |
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