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參數(shù)資料
| 型號： | SI5327D-C-GMR |
| 廠商： | SILICON LABORATORIES |
| 元件分類： | 時鐘產(chǎn)生/分配 |
| 英文描述： | 243 MHz, PROC SPECIFIC CLOCK GENERATOR, QCC36 |
| 封裝： | 6 X 6 MM, ROHS COMPLIANT, MO-220VJJD, QFN-36 |
| 文件頁數(shù)： | 4/60頁 |
| 文件大小： | 715K |
| 代理商： | SI5327D-C-GMR |
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Si5327
12
Preliminary Rev. 0.4
Output Duty Cycle
Uncertainty @
622.08 MHz
CKODC
100
Load
Line-to-Line
Measured at 50% Point
(Not for CMOS)
——
+/-40
ps
LVCMOS Input Pins
Minimum Reset Pulse
Width
tRSTMN
1—
—
s
Reset to Microproces-
sor Access Ready
tREADY
——
10
ms
Input Capacitance
Cin
——
3
pF
LVCMOS Output Pins
Rise/Fall Times
tRF
CLOAD = 20pf
See Figure 2
—25
—
ns
LOSn Trigger Window
LOSTRIG
From last CKINn
to
Internal detection of LOSn
N3 ≠ 1
—
4.5 x N3
TCKIN
Time to Clear LOL
after LOS Cleared
tCLRLOL
LOS to LOL
Fold = Fnew
Stable Xa/XB reference
—10
—
ms
Device Skew
Output Clock Skew
tSKEW
of CKOUTn to of
CKOUT_m, CKOUTn
and CKOUT_m at same
frequency and signal
format
CKOUT_ALWAYS_ON =1
SQ_ICAL =1
——
100
ps
Phase Change due to
Temperature
Variation*
tTEMP
Max phase changes from
–40 to +85 °C
—300
500
ps
Table 4. AC Specifications (Continued)
(VDD = 1.8 ± 5%, 2.5 ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
*Note:
Input to output phase skew after an ICAL is not controlled and can assume any value.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SI5334B-A00122-GM | PLL BASED CLOCK DRIVER, QCC24 |
| SI5334C-A00129-GMR | PLL BASED CLOCK DRIVER, QCC24 |
| SI5334C-A00153-GM | PLL BASED CLOCK DRIVER, QCC24 |
| SI5334C-A00160-GM | PLL BASED CLOCK DRIVER, QCC24 |
| SI5334A-A00102-GM | PLL BASED CLOCK DRIVER, QCC24 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| SI5328B-C-GMR | 制造商:Silicon Laboratories Inc 功能描述:IC CLK MULTIPLIER ETH 36QFN |
| SI5328C-C-GM | 制造商:Silicon Laboratories Inc 功能描述:G.8262 SYNCE CLOCK MULTIPLIER/JITTER ATTENUATOR - Trays 制造商:Silicon Laboratories Inc 功能描述:IC TIMING CLOCK 36QFN 制造商:Silicon Laboratories Inc 功能描述:Clock Generators & Support Products G.8262 SyncE Clock Multiplier |
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