(VDD = 1.8 ± 5%, 2.5 ±10%, or 3.3 V ±10%," />
參數(shù)資料
型號(hào)： SI5326C-C-GM
廠商： Silicon Laboratories Inc
文件頁(yè)數(shù)： 45/72頁(yè)
文件大?。?/td> 0K
描述： IC ANY-RATE MULTI/ATTEN 36-QFN
標(biāo)準(zhǔn)包裝： 490
系列： DSPLL®
類(lèi)型： 時(shí)鐘放大器，振動(dòng)衰減器
PLL： 是
輸入： 時(shí)鐘
輸出： CML，CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 346MHz
除法器/乘法器： 是/是
電源電壓： 1.71 V ~ 3.63 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 36-VFQFN 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝： 36-QFN（6x6）
包裝： 管件
產(chǎn)品目錄頁(yè)面： 628 (CN2011-ZH PDF)
其它名稱： 336-1746
336-1746-5
336-1746-ND
Si5326
Rev. 1.0
5
Table 2. DC Characteristics
(VDD = 1.8 ± 5%, 2.5 ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
Supply Current1
IDD
LVPECL Format
622.08 MHz Out
Both CKOUTs Enabled
—251
279
mA
LVPECL Format
622.08 MHz Out
1 CKOUT Enabled
—217
243
mA
CMOS Format
19.44 MHz Out
Both CKOUTs Enabled
—204
234
mA
CMOS Format
19.44 MHz Out
1 CKOUT Enabled
—194
220
mA
Disable Mode
—
165
—
mA
CKINn Input Pins2
Input Common Mode
Voltage (Input Thresh-
old Voltage)
VICM
1.8 V ± 5%
0.9
—
1.4
V
2.5 V ± 10%
1
—
1.7
V
3.3 V ± 10%
1.1
—
1.95
V
Input Resistance
CKNRIN
Single-ended
20
40
60
k
Single-Ended Input
Voltage Swing
(See Absolute Specs)
VISE
fCKIN < 212.5 MHz
0.2
—
VPP
fCKIN > 212.5 MHz
0.25
—
VPP
Differential Input
Voltage Swing
(See Absolute Specs)
VID
fCKIN < 212.5 MHz
0.2
—
VPP
fCKIN > 212.5 MHz
0.25
—
VPP
Output Clocks (CKOUTn)3
Common Mode
CKOVCM
LVPECL 100
load line-
to-line
VDD –
1.42
—VDD –1.25
V
Notes:
1.
Current draw is independent of supply voltage
2.
No under- or overshoot is allowed.
3.
LVPECL outputs require nominal VDD ≥ 2.5 V.
4.
This is the amount of leakage that the 3-Level inputs can tolerate from an external driver. See Si53xx
Family Reference Manual for more details.
5.
LVPECL, CML, LVDS and low-swing LVDS measured with Fo = 622.08 MHz.
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