參數(shù)資料
型號： SI5326C-C-GM
廠商： Silicon Laboratories Inc
文件頁數(shù)： 16/72頁
文件大?。?/td> 0K
描述： IC ANY-RATE MULTI/ATTEN 36-QFN
標(biāo)準(zhǔn)包裝： 490
系列： DSPLL®
類型： 時(shí)鐘放大器，振動(dòng)衰減器
PLL： 是
輸入： 時(shí)鐘
輸出： CML，CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 346MHz
除法器/乘法器： 是/是
電源電壓： 1.71 V ~ 3.63 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 36-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 36-QFN（6x6）
包裝： 管件
產(chǎn)品目錄頁面： 628 (CN2011-ZH PDF)
其它名稱： 336-1746
336-1746-5
336-1746-ND
Si5326
Rev. 1.0
23
Reset value = 1110 0100
Reset value = 0100 0010
Register 1.
Bit
D7D6D5D4D3D2D1D0
Name
Reserved
CK_PRIOR2 [1:0]
CK_PRIOR1 [1:0]
Type
RR/W
R/W
Bit
Name
Function
7:4
Reserved
Reserved.
3:2
CK_PRIOR2
[1:0]
CK_PRIOR 2.
Selects which of the input clocks will be 2nd priority in the autoselection state machine.
00: CKIN1 is 2nd priority.
01: CKIN2 is 2nd priority.
10: Reserved
11: Reserved
1:0
CK_PRIOR1
[1:0]
CK_PRIOR 1.
Selects which of the input clocks will be 1st priority in the autoselection state machine.
00: CKIN1 is 1st priority.
01: CKIN2 is 1st priority.
10: Reserved
11: Reserved
Register 2.
Bit
D7D6D5D4D3D2D1D0
Name
BWSEL_REG [3:0]
Reserved
Type
R/W
R
Bit
Name
Function
7:4
BWSEL_REG
[3:0]
BWSEL_REG.
Selects nominal f3dB bandwidth for PLL. See DSPLLsim for settings. After BWSEL_REG
is written with a new value, an ICAL is required for the change to take effect.
3:0
Reserved
Reserved.
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PDF描述
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參數(shù)描述
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SI5327B-C-GMR 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 Lo Loop BW Clk Multi Jitter Attn 2In/Out RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
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