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參數(shù)資料
| 型號： | SI5326C-C-GM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 18/72頁 |
| 文件大小： | 0K |
| 描述： | IC ANY-RATE MULTI/ATTEN 36-QFN |
| 標準包裝： | 490 |
| 系列： | DSPLL® |
| 類型： | 時鐘放大器，振動衰減器 |
| PLL： | 是 |
| 輸入： | 時鐘 |
| 輸出： | CML，CMOS，LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 346MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 1.71 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 36-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 36-QFN（6x6） |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 628 (CN2011-ZH PDF) |
| 其它名稱： | 336-1746 336-1746-5 336-1746-ND |
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Si5326
Rev. 1.0
25
Reset value = 0001 0010
Reset value = 1110 1101
Register 4.
Bit
D7D6D5D4D3D2D1D0
Name
AUTOSEL_REG [1:0]
Reserved
HIST_DEL [4:0]
Type
R/W
R
R/W
Bit
Name
Function
7:6
AUTOSEL_
REG [1:0]
AUTOSEL_REG [1:0]
.
Selects method of input clock selection to be used.
00: Manual (either register or pin controlled, see CKSEL_PIN)
01: Automatic Non-Revertive
10: Automatic Revertive
11: Reserved
See the Si53xx Family Reference Manual for a detailed description.
5
Reserved
Reserved.
4:0
HIST_DEL
[4:0]
HIST_DEL [4:0].
Selects amount of delay to be used in generating the history information used for Digital
Hold.
See the Si53xx Family Reference Manual for a detailed description.
Register 5.
Bit
D7D6D5D4D3D2D1D0
Name
ICMOS [1:0]
Reserved
Type
R/W
R
Bit
Name
Function
7:6
ICMOS [1:0] ICMOS [1:0].
When the output buffer is set to CMOS mode, these bits determine the output buffer drive
strength. The first number below refers to 3.3 V operation; the second to 1.8 V operation.
These values assume CKOUT+ is tied to CKOUT-.
00: 8mA/2mA
01: 16mA/4mA
10: 24mA/6mA
11: 32mA/8mA
5:0
Reserved
Reserved.
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| SI5327B-C-GMR | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 Lo Loop BW Clk Multi Jitter Attn 2In/Out RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
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